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▍1. verilog 串口多字节发送程序

verilog 串口多字节发送程序，波特率计算公式如下：cnt_baud =(1/9600bps)/(1/crystal_frq(Mhz))-1；可以发送多个字节的数据，但是字节数是固定的

2023-09-08发布

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▍2. 并行LMS均衡FPGA实现

实现FPGA的并行LMS均衡，主要是均衡计算权值系数的算法过程，verilog语言，模块的输入为输入的X信号，输出为权值系数W，以及最后的输出Y。实现了LMS 的并行均衡过程

2023-09-08发布

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▍3. 基于FPGA的UART功能实现

基于FPGA的UART功能实现，包含四个模块，波特率产生，顶层，发送和产生模块。

2023-09-08发布

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▍4. AXI slave

一个AXI slave的Verilog实现代码，内部有基于UVM编写的testbench,该slave是基于AXI3协议来实现的，可以给初学者一些启示

2023-09-07发布

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▍5. qsys-niosii-triple-speed-ethernet-3c120-v10-1

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2023-09-07发布

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▍6. i2C verilong slave&master 代码分析

I2C verilong code 详细代码分析，根据协议每一步都有分析，进过验证，代码分slave和master部分，代码比较成熟

2023-09-05发布

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▍7. 基于nios2的花样灯

基于Qsys的嵌入式软核设计，基于Quartus的顶层模块设计，以及利用简单的C语言在nios2中实现花样灯的程序。实验的芯片是飓风二代，EP2C8Q208C8开发板。

2023-09-05发布

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▍8. UVM SV阶段

此代码演示基本的层次结构构造和逐步 UVM 的测试。每一位 UVM 组件适用于自动化的阶段执行要了解如何逐步作品是否自上而下或自下而上使用此代码。

2023-09-04发布

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▍9. MAX2769配置源码_配置参数经过实际工程考验

对常用的射频端下变频的MAX2769芯片进行GPSL1频点配置，实测有效，该配置参数是经过实际工程验证的，现在也应用于实际项目中

2023-09-04发布

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▍10. 单周期CPU设计完整代码

实验课作业，下载可以直接跑，各个模块的完整代码。

2023-09-02发布

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▍11. FPGA 64位除法器 verilog

用verilog语言实现的除法器，实现方式为移位减

2023-09-02发布

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▍12. SD 基于引用 verilog CRC7 计算器

能为 sd 和 eMMC 参考，基于 verilog 的计算器计算 crc7，你会喜欢它。很好，说的源代码是太瘦了，没问题，但是你能感觉到，代码本身是很好的尽你所能 see.also，包含.exe 程序计算，其中你可以竞争。

2023-08-31发布

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▍13. 800 x 600 60 Hz VGA 控制器 FLEX10

800 x 600 60 hz VGA 控制器。简单的 verilog 代码。软件项目包括。

2023-08-31发布

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▍14. 基于FPGA的串口通信设计

本代码我们做的是“回环测试”，上微机首先通过串口通信发送数据到FPGA，FPGA接收到数据以后再将其发回给上位机，通过观察上位机的数据显示窗口，我们就能确定基于FPGA的串口数据手法是否正确。

2023-08-30发布

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▍15. This code is used for mpeg-2 encode,transform 188bit to 204bit(RS code)

2023-08-30发布

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▍16. 基于fpga的计算器

资源描述基于fpga的一个简易计算器程序，能够通过开发板输入，并且通过开发板数码管显示出来

2023-08-27发布

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▍17. i2c_master_bfm仿真模型

i2c_master_bfm，可以直接使用实现i2c master的仿真功能

2023-08-23发布

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▍18. verilog实现二维卷积设计

利用Verilog实现了二维卷积的操作，输入特征图尺寸为7x7，卷积核尺寸为5x5，分别使用了折叠、脉动阵列行固定、脉动阵列权重保持三种硬件实现设计方法来完成二维卷积的设计。

2023-08-23发布

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▍19. TLC5615 FPGA(EP2C08)

用Verilog硬件语言驱动TLC5615 DAC芯片,可输出方波,并且频率可调

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▍20. DE2115串口收发源码

利用DE2115开发板进行串口通信，完成串口的发送，将板子上的滑动按键的状态通过串口传至上位机，并且在LED上显示。

2023-08-21发布

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