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2022-10-13发布

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2022-10-11发布

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这是一个异步的FIFO模块，还有5个部分，比较器，写满读空状态标志，和一个RAM模块，是编写一些大型程序的基础模块。谢谢大家，期望大家能够用得着

2022-10-11发布

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并行前缀加法器（也被称为carrytree

2022-10-09发布

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▍5. 模拟Sim的简单代码

module example_3_1(A, B, C, D, E); output D, E; input A, B, C; wire w1; and G1(w1, A, B); not G2(E, C); or G3(D, w1, E); endmodule

2022-10-09发布

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▍6. kc705 sdi demo

使用sdi 对采集到是视频数据进行解码，转为bt656数据格式的数据进行输出

2022-10-08发布

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▍7. 阿尔特拉发动机控制器示例

此应用描述了步进式发动机控制器，你可以控制发动机

2022-10-07发布

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▍8. Verilog 仲裁器

有四个层次的轮循仲裁器。这是由 WD Peterson 在 vhdl 语言编码的衍变

2022-10-07发布

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▍9. 与非门的 rtl 代码

RTL设计与VHDL代码；nbsp；VHDL代码RTL设计的VHDL代码RTL设计的VHDL代码RTL代码designvhdl designvhdl RTL代码RTL代码designvhdl designvhdl RTL代码designvhdl RTL设计RTL代码

2022-10-07发布

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▍10. 基于FPGA驱动高速AD/DA

有三个基于FPGA驱动高速AD/DA的程序、硬件电路图、使用向导手册、连接方法，支持ADDA_AX301，ADDA_AX415，ADDA_DB2C8，可以下载到 FPGA 黑金开发板、FPGA 黑金开发板学生版结合相关模块进行使用，

2022-10-06发布

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▍11. xilinx读取DEVICE DNA源码

网上有类似的源码（dna_rd.v）但是有错误，里面第133行起，有两句没有放在begin end 里面，原本执行s6的状态机是有选择的进入s5或s7，而遗漏begin end 是直接进入s7，因此执行错误，dna读取全为0

2022-10-06发布

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▍12. 7×7交叉使用Verilog

这是Verilog代码使用Verilog实现交叉。

2022-10-06发布

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▍13. verilog code of counter with clock divider for fpga implementation

带时钟分频器的计数器的代码是用verilog编写的。代码是用verilog HDL编写的，完全可以合成，可以在FPGA上实现；

2022-10-05发布

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▍14. 使用FPGA SPARTAN-3E 的ledbanner verilog代码

在 verilog 代码中使用 FPGA 斯巴达 3E Ledbanner 显示 0-9 中 2 七段显示器。它会从左去附和胜利或反之亦然。和当按重置按钮时将重置功能。

2022-10-05发布

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▍15. fpga Verilong 实现以太网

在fpga下，完全用verilong编写的以太网程序，可以进行tcp/IP通信，请不要用在商业用途中，谢谢

2022-10-05发布

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▍16. I2C串行协议

I²C（内部集成电路，称为I-平方-C，I-2-C中，或IIC）是由飞利浦发明的多主串行单端计算机总线用于连接低速外围设备的母板，嵌入式系统，蜂窝电话，或其他电子设备。为了不被混淆的术语双线接口，只描述了一个兼容的硬件接口。自1990年代中期以来，一些竞争对手（例如，西门子公司（后来的英飞凌科技股份公司，目前英特尔移动通信），NEC，德州仪器，意法半导体（前身SGS - 汤姆逊），摩托罗拉（后来飞思卡尔），Intersil公司等）带来的I²C产品在市场上，这是与恩智浦（前身为飞利浦半导体部门）I²C系统完全兼容。自2006年10月10日，是不需要授权费来实现I²C协议。但是，收费仍需要获得恩智浦分配I²C从地址。[1]SMBus的，由英特尔在1995年的定义，是I²C的是更严格地定义了协议的一个子集。 SMBus的一个目的是促进稳健性和互操作性。因此，现代的I²C系统整合的政策和规则由SMBus，有时同时支持I²C和SMBus需要最小的重新配置。

2022-10-04发布

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▍17. 任意波形发生器

任意波形发生器，通过计数器并结合拼接操作产生四种波形正弦波，方波，三角波，斜三角波。通过数据选择端（2位）共四种模式确定选择产生上述四种波形中的哪一种波形。波形的形状是由若干个坐标的点连接而成。

2022-10-03发布

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▍18. verilog实现CPU处理系统

利用verilog实现硬件上的简单的CPU处理系统，并可以处理简单的汇编语言代码。本代码实现的是CPU上的汇编语言的单周期执行。

2022-10-03发布

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▍19. UART模块

在FPGA上用Verilog实现的UART串口通信模块，包含分频模块，接收模块，发送模块，可以更改波特率，适合初学者学习，已经在板子上得到了验证。

2022-10-02发布

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▍20. 如何提取嘴唇检测

你好附上有不同的图像搜索可用的链接的所有图像。

2022-09-28发布

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