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▍1. 各大IT、软件、硬件公司薪资

本文档内容是各大公司的薪资，各位可以了解一下，绝对真实，具体到个位数。

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2023-04-05发布
Verilog Verilog

▍2. 故障时钟检测电路的设计

采用延时锁相环设计时钟延时电路，然后通过比较时钟信号来判断时钟信号是否发生时毛刺。压缩文件是一个VIVADO2015.1写的工程，包括测试文件，verilog语言编写

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2023-04-02发布
Verilog Verilog

▍3. DDS数字信号发生器

自己编写的DDS发生器，方波、三角波、正弦波、还可以输入任意的波形文件

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2023-04-02发布
Verilog Verilog

▍4. 基于fpga的SPI接口实现

本工程是基于Altera Cyclone系列的FPGA来实现的SPI接口，使用Verilog代码编写，能够进行 8位、 16位 、 32位数据传输的可选操作。

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2023-04-02发布
Verilog Verilog

▍5. cordic

不同角度cordic在接收端的解调

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2023-04-02发布
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▍6. 吠陀乘数32位

高速32位吠陀乘数使用吠陀数学设计。这有一个比其他类型的乘法器，非常少的延迟。

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2023-04-01发布
Verilog Verilog

▍7. 网络上的芯片

设计处理最小化路由器端口五口三个端口，这样我们可以节省功耗和面积。

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2023-04-01发布
Verilog Verilog

▍8. verilog编写的1024点的fft快速傅立叶变换代码

verilog编写的1024点的fft快速傅立叶变换代码                                                                                                                                                     

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2023-03-30发布
Verilog Verilog

▍9. cpu mips

实现多周期mips  设计一个32位MIPS多周期微处理器 具有多种 算数指令： (Design a 32-bit MIPS microprocessor multi-cycle arithmetic instructions

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2023-03-29发布
Verilog Verilog

▍10. 中值滤波verilog

中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog中值滤波verilog

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2023-03-28发布
Verilog Verilog

▍11. verilog大量例程

学习verilog中常见的编程方法和例子。欢迎大家下载、试用。谢谢大家的支持！

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2023-03-27发布
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▍12. 录像带上 ALtera DE2 教育委员会，旋风 2

录像带上 ALtera DE2 教育委员会，旋风 2 EP2C35F672C6

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2023-03-26发布
Verilog Verilog

▍13. 汉/解码器

应用背景执行汉明编码和解码的32bit数据。关键技术Verilog代码的执行，汉明码在单时钟周期的32位数据编码。 ；Verilog代码进行汉明编码解码和单时钟周期的32位数据纠错。 ；试验台包括验证码。 ；在artix-7 100t现场可编程门阵列测试。简化的界面。

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2023-03-26发布
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▍14. 浮点单元

本文档介绍了Verilog双精度浮点内核，这些

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2023-03-23发布
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▍15. 仲裁者Verilog

这是编码在 Verilog 用于由 4 个不同端口循环赛样式选择仲裁。理解的状态机的概念，最后我已经编写了代码和台架测试，验证之后它彻底， 请看下面的代码， 注意;-它是有一个轮循仲裁设计一样 我们的任务和功能的一部分是，它不得不等待下一个请求按递增的顺序，直到它给格兰特为该请求。

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2023-03-20发布
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▍16. TS 传输流的同步检测模块，该模块可以完成对输入的ts流的同步头检测和跟踪功能

TS 传输流的同步检测模块，该模块可以完成对输入的ts流的同步头检测和跟踪功能，使用该模块，需要注意的是，工作的时钟频率应该搞于ts流的输入时钟 2 倍以上，这样完成对ts流的低码流到系统时钟频率的转换和同步功能

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2023-03-20发布
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▍17. firstinfirstout block

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2023-03-15发布
Verilog Verilog

▍18. 第七部分 串口Uart通信例程

UART是一种通用串行数据总线，用于异步通信。该总线双向通信，可以实现全双工传输和接收。在FPGA开发板设计中，UART用来与PC进行通信，包括数据通信，命令和控制信息的传输。实验之前我们先来了解一下Uart的通信协议和传输时序。

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2023-03-15发布
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▍19. verilog经典设计实例

学习verilog过程中总结的54个经典设计实例，供verilog初学者入门学习，掌握编程技巧。实例包括：计数器、加法器、数据寄存器、锁存器、进程函数，以及小型工程项目如交通信号灯系统，乐曲演奏，简单编码器等设计实例。

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2023-03-14发布
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▍20. verilog实现流水线mips

个人作业，mips流水线cpu，支持mips-c3指令集

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2023-03-11发布
Verilog Verilog

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