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  1. 编程语言：Verilog
  2. 代码类别：所有
  3. 发布时间：今天
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▍1. ADPLL 行为模型

附加的文件包含 ADPLL 的行为模型。 6 位贸发局用。一个快速的时钟用来计算输入的参考时钟和反馈时钟之间的时间性差异。 贸发局决议是如果快速的时钟速度更快更高。 数字环路滤波器生成 14 数字控制位控制 DCO 的频率。 14 位 DAC 用于方便控制 DCO 由像控制 VCO 的手段。 4330 分隔线用于附加的文件。

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2022-04-18发布
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▍2. crc冗余编码

提供了比较详细的crc编解码，有8、16、24、32可以选择，可以进行重复编码，重复触发，对学习crc有很大帮助，采用了LFSR模式编写

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2022-04-16发布
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▍3. 曼彻斯特编码和解码

它包含了曼彻斯特编码和解码的Verilog文件。它解释了曼彻斯特编码方案和解码方案的基本原则1553总线结构。它给人的主意，还写Verilog代码

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2022-04-16发布
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▍4. MIPS32五级流水线CPU Verilog代码，注释清晰，供学习

应用背景 Verilog 实现 MIPS32 V1整数指令集， 5级流水线CPU 没有文档，按照流水线划分模块，代码注释多，便于理解。FPGA验证通过，可综合。 关键技术五级流水线MIPS处理器verilog源码，实现MIPS32的整数指令，代码风格好，注释清晰，适用于计算机体系结构的理解及实践，了解MIPS体系结构有很大帮助

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2022-04-16发布
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▍5. SPI接口代码

对SPI接口的verilog编程，SPI is a simple interface that allows one chip to communicate with one or more other chips.   

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2022-04-16发布
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▍6. SPI模块设计

一个串口通信传输的实验程序设计，在一般的通信协议中涉及到数据发送与接收的问题，为了快速实现数据的发送，通常使用的是串行传输的方法，把数据一个一个的发送出去，因此这里设计了一个发送程序。

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2022-04-16发布
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▍7. 树枝毛茸茸的乘数

它是一种算法，它是用来在超大规模集成电路的乘法2

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2022-04-14发布
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▍8. 基于FPGA的DDR3控制器

这个代码为基于XILINX FPGA的DDR3控制部分，实用性很强，忍痛拿来分享，望各位笑纳。

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2022-04-13发布
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▍9. 适合CPU初学者

本文使用三级流水线的方式实现CPU。该CPU工实现加、减、移位、跳转等十多条常用指令。并在FPGA开发板中成功实现流水灯。频率能达到200M.该CPU实现的方式简单，适合初学者学习。里面有详细代码和指令结构。

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2022-04-12发布
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▍10. verilog sram

用于控制SRAM，16bit*1 M.  控制读取方向，严格按照时序图进行延迟设计，非常适合参考设计，用于其他相关开发。希望对大家有用。 用于控制SRAM，16bit*1 M.  控制读取方向，严格按照时序图进行延迟设计，非常适合参考设计，用于其他相关开发。希望对大家有用。

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2022-04-12发布
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▍11. RTL_NAND_Flash_controller-master

RTL_NAND_Flash_controller-master，基础入门控制器，内存管理，fpga实现。miicron所属，

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2022-04-12发布
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▍12. 基于FPGA驱动高速AD/DA

有三个基于FPGA驱动高速AD/DA的程序、硬件电路图、使用向导手册、连接方法，支持ADDA_AX301，ADDA_AX415，ADDA_DB2C8，可以下载到 FPGA 黑金开发板、FPGA 黑金开发板学生版结合相关模块进行使用，

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2022-04-11发布
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▍13. ov5620在FPGA中的使用

ov5620在FPGA中的使用，本程序实现的功能是驱动摄像头OV5620，并将数据通过VGA接口输出，外接显示器即 看到摄像头的图像。

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2022-04-11发布
Verilog Verilog

▍14. 展位乘数

它是一种算法，它是用来在超大规模集成电路的乘法2

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2022-04-11发布
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▍15. AHB 转移到 APB 源和建业读/写 verilog 代码

转换AHB外围转移到APB转移16槽孔APB桥提供高速AHB之间的界面域和低功率的APB域。大桥出现在AHB奴隶，而在APB，它是主人。读取和写入的AHB接送转换成相应的APB传输。由于APB不流水线，等待状态转移过程中加入，并从建业的时候在AHB需要等待APB协议。在AHB到APB桥包括一个状态机，它被用来控制产生的APB和AHB输出信号，以及地址解码逻辑，用于生成所述APB外设选择线。在系统中使用的所有寄存器被从的上升沿时钟系统时钟HCLK，并使用异步复位HRESETn

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2022-04-10发布
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▍16. AHB总线相关协议代码

AHB BUS 的一些接口代码， verilog, 希望对初学AHB总线的兄弟有所帮助。 里面包含 ahb decode, ahb_mux and ahb2mem. 以及相应的验证环境， 此代码只用于学习，如果用于项目，仅供参考。

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2022-04-10发布
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▍17. 一个UART协议验证

一个 ；通用异步接收器/发送器UART，简称 ； ；/ˈ居ːɑːRT /，是 ；计算机硬件 ；设备之间的数据并行转换 ； ；和 ；serialfo

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2022-04-10发布
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▍18. 一个基于Verilog语言的简单处理器

     该程序为使用Verilog HDL语言设计的一个可以根据输入的指令完成不同的操作的简单处理器，可实现mv,mvi,add,sub四个汇编指令，并且使用Quartus II可对该程序进行仿真，最后下载至DE2开发板中可对处理器功能进行验证。

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2022-04-10发布
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▍19. ICAP 回读处理

通过 ICAP 回读 FPGA内部state register 的状态值。通过状态机控制ICAP，然后写入命令，读取数据，等待三个周期后出现数据。过程中CSIB和RDWRB有一个时序关系，还需要对ICAP输入命令进行bit swap

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2022-04-10发布
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▍20. BGM benchmark

// DEFINES `define BITS 32         // Bit width of the operands `define NumPath 34        module bgm(clock,  reset, sigma_a,  sigma_b,  sigma_c, Fn, dw_x, dw_y, dw_z, dt, Fn_out  ); // SIGNAL DECLARATIONS input clock; input reset; input [`BITS-1:0] sigma_a; input [`BITS-1:0] sigma_b; input [`BITS-1:0] sigma_c; input [`BITS-1:0] Fn; input [`BITS-1:0] dw_x; input [`BITS-1:0] dw_y; input [`BITS-1:0] dw_z; input [`BITS-1:0] dt;

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2022-04-09发布
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