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1. For communications in the dsb system so the realization of the hardware simulati...

对于在dsb系统中进行通信所以实现的硬件仿真和验证,对大家有一定的帮助谢谢

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2022-12-04发布

2. 实现大型LED屏显示的CPLD程序,对FPGA学习很有帮助

实现大型LED屏显示的CPLD程序,对FPGA学习很有帮助-To achieve large-scale LED screen display of the CPLD program, very helpful for learning FPGA

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2022-12-04发布

3. 跑马灯led_horse vhdl cpldfpga

跑马灯led_horse vhdl cpldfpga-led_horse vhdl cpldfpga

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2022-12-03发布

4. 控制AD采样的程序,希望对大家能有所帮助!不对之处请多多指导!...

控制AD采样的程序,希望对大家能有所帮助!不对之处请多多指导!-I think it is a goog pragram ,I hope it is good for you !

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2022-12-02发布

5. 这是一个用vhdl编的多功能电子秒表,可以记录几个人的时间,并且可以在跑秒的时候查看记录。。〔原创〕...

这是一个用vhdl编的多功能电子秒表,可以记录几个人的时间,并且可以在跑秒的时候查看记录。。〔原创〕-This is a series with VHDL multifunctional electronic stopwatch, can be recorded by several people, and that they could run in the second examined the records. . [Original]

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2022-12-02发布

6. descripe by the VHDL to drive the LCD cm12864,based on the FSM convertor,achieve...

cm12864液晶显示器的vhdl驱动代码,基于状态机的转换,实现显示功能。-descripe by the VHDL to drive the LCD cm12864,based on the FSM convertor,achieve the display function.

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2022-12-01发布

7. 此文件给出了一个多功能交通灯的VHDL代码实现,可作为电赛的准备材料...

此文件给出了一个多功能交通灯的VHDL代码实现,可作为电赛的准备材料-This paper gives a multi-functional traffic lights to achieve the VHDL code can be used as electric materials Cup preparations

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2022-12-01发布

8. 在 FPGA 中实现 SPI 接口

在 FPGA,SPI、 I2C 等 ASI,串行接口的实现来武力作为需要实现外围设备之间的接口。这个项目给 VHDL 源代码实施 SPI 接口和他们有关的文件。

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2022-12-01发布

9. NIOS II IDE 编程, uart_txd测试程序,仅供参考。

NIOS II IDE 编程, uart_txd测试程序,仅供参考。-NIOS II IDE programming, uart_txd testing procedures, for information purposes only.

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2022-11-30发布

10. 一个可用的很不错的DDS 频率合成程序,用VHDL语言编写

一个可用的很不错的DDS 频率合成程序,用VHDL语言编写-Available is a good DDS frequency synthesis procedures, using VHDL language

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2022-11-29发布

11. this is a verilog code about serial transmit receive.

this a verilog code about serial transmit receive.-this is a verilog code about serial transmit receive.

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2022-11-29发布

12. 基于FPGA的电子时钟设计

具体设计内容计时功能:电子表的基本功能,要求用LCD显示,显示格式是时、分、秒;校时功能:用户可以更改当前时间。设置闹钟时间:用户可以设置闹钟时间,其操作过程与校时过程一样;整点报时开关:整点报时可以由用户设定为开启或关闭两种状态,当整点报时开启时,电子表会在整点时发出1秒的闹铃声(在UP3的板上用一个LED表示);闹钟功能开关:闹钟由用户设定为开启或关闭,当闹钟开关开启时,如果当前时间与设置的闹钟时间一致,发出长达10秒的闹铃声;

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2022-11-29发布

13. Low

低通滤波器在QUARTUS7.0开发环境下的文本与框图结合的实现方法的源代码-Low-pass filter QUARTUS7.0 development environment in the text and diagram combination of methods to achieve source code

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2022-11-29发布

14. DDS signal generator, can produce a variety of waveforms, are mysterious wave, t...

DDS信号发生器,能产生多种波形,正玄波,三角波,方波,频率可调,相位可调-DDS signal generator, can produce a variety of waveforms, are mysterious wave, triangle wave, square wave, frequency tunable, phase adjustable

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2022-11-28发布

15. osiclator LED

应用背景弗鲁托PA oscilar就像联合国领导是卡瓦依,zholo罗该为什么我需要一个接着一个普通该estudielo为什么deberia darselo masticado关键技术zh0lo VHDL l0ks,就像PA presumir Y阙我书房一个接着一个普通免费,但四sintetiza Y有她comportamiento寺特拉华入伍机构sincronizar O把一osiclar DOS LED

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2022-11-27发布

16. Verilog HDL实现的I2C Slave模拟

Verilog HDL实现的I2C Slave模拟-achieve the Verilog HDL simulation I2C Slave

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2022-11-26发布

17. 一个有效的高吞吐量的FPGA的AES实现多千兆位协议

应用背景在本文中,我们提出了一种高效的非流水线式AES-128实现高实施吞吐量,以便它可以使用在千兆协议。我们实现我们的AES-128加密设计在Xilinx Virtex-7 FPGA解密了4.86 Gbps的5.30/ ECB模式和5.23/4.84吞吐量在CBC模式Gbps。关键技术由于高吞吐量的要求加密信道的体系结构,一种高效的实施硬件是必要的。这可以实现通过使用高端可重构智能利用平台。实现令人信服的高吞吐量,一高效的非流水线式的先进实现数据加密标准(AES)和密钥长度为128比特,用于千兆位现场可编程门阵列(FPGA)协议提出。

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2022-11-26发布

18. I2CVHDLASDASDADASD

内容太短。注意请: 代码没有很好的描述将被删除,你不会得到任何点。请描述一下更好地获得更多积分。

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2022-11-26发布

20. 基于单片机与CPLD的 等精度频率计,VHDL语言

基于单片机与CPLD的 等精度频率计,VHDL语言-Based on SCM and CPLD

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2022-11-25发布