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FPGA秒表

于 2023-01-19 发布 文件大小:1.41 MB
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代码说明:

基于 Xilinx Spartan 6 的、在七段译码管上显示、用按键控制计时开始、结束、逐秒累加功能的verilog代码,同时它是此开发板的一个demo工程,也是中山大学移动信息工程课程作业项目之一。希望对有需要参考的孩子有所帮助

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • Ultrasound
    软件环境:TI的zstack协议栈 硬件:CC2530无线单片机 功能:利用超声波模块实现测距(该模块型号:HC-SR04 在淘宝上非常常见) 可测2厘米到3米距离(Software environment: TI' s zstack protocol stack hardware: CC2530 wireless microcontroller features: use of ultrasonic ranging module (the module Model: HC-SR04 on Taobao very common) can be measured 2 cm to 3 meters)
    2020-12-28 23:39:02下载
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  • AMBA 3 协议
    APB 是 AMBA 3 协议家庭的一部分。它提供一个低成本的界面,优化为最小的功率消耗和减少的界面的复杂程度。APB 接口到任何外围设备,低带宽并不需要高性能的流水线的总线接口。APB 了 unpipelined 协议。所有的信号转换只与有关的时钟,使 APB 外设容易融入任何设计流量的上升沿。每一次转让需要至少两个周期。APB can 接口的 AMBA 先进的高性能总线建兴 (AHB Lite) 和 AMBA 先进的可扩展接口 (希)。你可以使用它来提供对外围设备的可编程控制寄存器的访问。
    2022-03-15 10:49:53下载
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  • ldpc算法
    Basic principle of LDPC code and FPGA implementation of LDPC code
    2020-06-22 20:00:01下载
    积分:1
  • DFT
    说明:  DFT FPGA实现,simulink到vivado(DFT FPAG implement base on simulink and HLS)
    2020-09-22 18:08:58下载
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  • 移相器 verilog
    这是移位器对Verilog一个桶式移位器的结构通用的方法需要生成块。 for循环中产生块将揭开在编译时,不运行时间就像一个for循环像一个永远阻塞。为了保持它的通用也有有2比1多路复用器有一个参数化的宽度。仅供参考,你可以使用与功能代码太生成模块,例如注释掉mux_2to1实例并取消它下面的赋值语句。通过读取IEEE标准1800年至2012年§27.生成结构了解更多有关生成块。
    2022-03-01 04:06:29下载
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  • zidongmen1
    控制步进电机转动,正反转,旋转角度完美掌握。很好用,亲测(Control stepping motor rotation, positive and negative rotation, perfect control of rotation angle. Very easy to use, personal test)
    2018-12-25 16:41:07下载
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  • AD
    说明:  FPGA控制AD7321的模块,是本人亲自试验过的。有Verilog源码,和简单文档。(FPGA control module of the AD7321 is personally tested. There Verilog source code, and simple document.)
    2009-08-18 20:31:53下载
    积分:1
  • 廉价 FPGA 实现模拟示波器方式显示
    用廉价 FPGA  实现 模拟示波器方式的显示,含 Quartus II 工程文件,原理图 PCB 图。
    2022-03-19 14:27:15下载
    积分:1
  • 基于FPGA的串口通信程序设计
    本代码是一个基于FPGA的串口通信程序设计,程序采用Verilog语言编写,工程中已经加入了仿真模型,并设置了仿真,如果你的电脑也安装了modelsim-altera,就可以直接点击RTL仿真,就能出仿真结果了。程序的主要功能实串口测试,当FPGA芯片收到上位机发送的数据时将数据再发回到上位机,在串口助手上进行显示。
    2022-03-22 10:58:18下载
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  • Uart发送跟接收
    UART 的接收跟发送 verilog写的 时序跟功能仿真也写在了里面
    2022-02-22 05:05:01下载
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