登录
首页 » VHDL » 基于FPGA的红外图像预处理系统的研究与设计,给fpga工程技术人员一个参考...

基于FPGA的红外图像预处理系统的研究与设计,给fpga工程技术人员一个参考...

于 2023-06-10 发布 文件大小:3.66 MB
0 57
下载积分: 2 下载次数: 1

代码说明:

基于FPGA的红外图像预处理系统的研究与设计,给fpga工程技术人员一个参考-FPGA-based infrared image preprocessing system and design, engineering and technical personnel to fpga a reference

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论


0 个回复

  • 使用vhdl语言编写的100个常用程序的例子
    使用vhdl语言编写的100个常用程序的例子-The use of VHDL language 100 examples of commonly used procedures
    2022-08-18 05:39:29下载
    积分:1
  • 10。对于密钥输入一个密码锁,假设重置后的七个香格里拉…
    10对于进入密码锁的按键,假设复位后七个灯显示0,使用sw1、sw2两个键输入,只要按sw1键,并使七个灯显示每秒速度加1的值,但释放sw1键后停止。
    2023-01-16 19:45:03下载
    积分:1
  • 3.4
    移位除乘法器带testbench好用的工程(Useful addition to the shift multiplier works with testbench)
    2011-07-26 10:54:46下载
    积分:1
  • regress-900055
    The Date prototype object is itself a Date object (its [[Class]] is "Date") whose value is NaN.
    2013-12-27 00:29:58下载
    积分:1
  • through CPLD to eight parallel data into serial data and methods can be used I2C...
    通过CPLD将8位并行数据转换为串行数据并可以采用I2C方式与其他器件连接,可以用于MCU需要与提供I2C接口器件通信的场合。-through CPLD to eight parallel data into serial data and methods can be used I2C connections with other devices, which can be used to provide MCU with I2C Interface Communications occasions.
    2022-05-30 15:43:30下载
    积分:1
  • 4x4Key_daisy090708
    使用Altera公司的FPGA进行VHDL开发。使用quartus2 9.0软件在EP1C3T144C8开发板上实现对4x4键盘的输入控制,并显示在一个8段式数码管上。(The use of Altera' s FPGA-VHDL development. Use quartus2 9.0 software EP1C3T144C8 the development board to realize 4x4 keyboard input control, and displayed in an eight-stage digital pipe.)
    2009-09-25 06:24:34下载
    积分:1
  • 用Verilog编写的USB下载线程序实现USB协议和JTAG…
    用verilog编写的USB下载线程序 实现USB协议和JTAG接口的数据转换实现状态机。-Verilog prepared using USB download cable program realize USB protocol and JTAG interface to achieve data conversion state machine.
    2022-01-22 17:32:28下载
    积分:1
  • AD9250 204b Verilog源码
    说明:  AD9250是一款双通道14位ADC,最高采样速率250 MSPS,JESD204B Subclass 0或Subclass 1编码串行数字输出(The ad9250 is a dual channel 14 bit ADC with a maximum sampling rate of 250 MSPs and jesd204b sub class 0 or sub class 1 coded serial digital output)
    2021-04-14 11:01:55下载
    积分:1
  • XAPP_585
    XAPP585 serdes_1_to_7 and serdes_7_to_1 data
    2021-02-04 13:49:57下载
    积分:1
  • SZ-VHDL
    系统数字逻辑电路设计方法以及示例的介绍,分析较好,有价值(System digital logic circuit design methods and introduce examples, analyze good and valuable)
    2014-03-30 08:34:05下载
    积分:1
  • 696518资源总数
  • 104432会员总数
  • 16今日下载