DDS实验 matlab 与quartus 的完美结合(DDS experimental combination of matlab and quartus)

本原代码中利用VHDL语言编写了RAM、FIFO、ROM等常用的存储和缓冲部件，完全的代码在ALTERA的FPGA上已经通过仿真测试，保证可用.-primitive code using VHDL prepared RAM, FIFO, ROM, and other commonly used storage and buffer components, complete code in the Altera FPGA simulation test has been passed to ensure that available.

随着社会的发展和科学技术的进步，现代社会对测量仪器的需 求越来越广，对仪器的性能要求也越来越高。在迅速发展的集成电 路技术和计算机技术的推动下，测量仪器也正发生巨大的变化。以 虚拟仪器为代表的新型测量仪器改变了传统仪器的思想，它们充分 利用计算机强大的软硬件功能，把计算机技术和测量技术紧密结合 起来。特别是基于计算机平台的各种测量仪器由于成本低、使用方 便等优点得到了更广泛的应用，在计算机普及率比较高的高等院校， 这种测量仪器对教学和科研都有重要的使用价值。 本文作者在对各种数字测量系统深入研究的基础之上，采用虚 拟仪器的思想，结合计算机的结构特点，设计出一套以计算机为平 台，包含信号采集与显示的综合测试系统。本系统包括有频率计、 示波器、频谱分析仪等多种仪器的功能。能对信号进行综合测量。 系统的关键部分是高速数据采集。系统中的逻辑控制部分采用CPLD 来实现，大大提高了系统的集成度。系统在信号的采样方法上采用 了一种新的方案并进行了试验验证。本文从系统总体设计的角度， 对整个系统的方案设计、制板、调试过程以及试验结果等方面进行 了详细论述。 -err

这个verilong代码实现的功能是radar processing的功能。(This verilong code function is radar processing functions.)

运用Quartus在LCM中显示静态宫殿图形-Use Quartus in LCM display static graphics palace

用verilog编写的信号调制解调程序，包括ask,fsk,qpsk的fpga实现(Prepared using verilog signal modulation and demodulation process, including ask, fsk, qpsk of fpga implementation)

说明：  本例的源描述超过了演示版限制的300行, 如果您需要对其进行编译与模拟,请与北京理工大学 ASIC研究所联系,获取Talent系统的完全版本. 联系方法: 电话:010-68912434 (The source described in this case than the demo version of the 300 line limit, if you need to be compiled with the simulation, please contact ASIC Institute of Beijing Institute of Technology to obtain the complete version of Talent system. Contact: Tel :010-68912434)

加密已经成为我们生活的一部分，我们

一个SDH中最基本传输模块STM-1的帧头检测器，verilog编程实现-A basic SDH transmission module STM-1 Header detector, verilog Programming