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测试图_彩条-可以改分辨率

于 2022-10-14 发布 文件大小:1.86 kB
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代码说明:

verilog实现的测试图,可设置分辨率。彩条发生器产生的由三基色、三补色以及黑白八种颜色按照亮度递减的顺序,从左至右依次排列的,竖条纹标准测试信号。 白——黄——青——绿——紫——红——蓝——黑;

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  • vhdl
    vhdl cpu芯片逻辑设计的一部分实现 只有一小部分 大家可以看一下 寄存器 加法器之类的(vhdl cpu chip logic design part of its implementation only a little part everry look and see b=about registers adder and so on)
    2012-09-23 16:57:41下载
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  • 32位除法器verilog设计
    使用了不恢复余数循环移位减法来实现除法功能,在硬件资源与除法周期之间取了折中,32位除法要进行32次移位减法,使用了5个64位的寄存器,一个周期做4次移位减法,8个周期完成一次除法操作。设计全部用verilog实现。详细算法见图:
    2023-01-08 07:15:02下载
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  • tuoji_fpga(xp2_8)_v2
    特大好消息,这是LED全彩控制卡的FPGA的源程序,做LED开发的,绝对有很好的价值(Big good news, this is full-color LED control card FPGA of the source, do LED development, the absolute value of good)
    2010-07-19 16:18:27下载
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  • dac
    简易函数发生器,能产生正弦波,三角波,梯形波,方波,并且可调频率和幅度值。(Simple function generator can produce sine, triangle wave, trapezoidal wave, square wave, and the adjustable frequency and amplitude values.)
    2011-08-28 14:11:37下载
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  • vhdl.9up
    have a good documenty
    2010-04-15 14:26:07下载
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  • myfir
    verilog编写的16阶升余弦滤波器 采用直接型结构实现 对方波进行滤波 输出波形 含testbench文件(order raised cosine filter verilog written 16 direct-type structure to achieve the other wave filtering the output waveform containing testbench file)
    2020-10-05 16:47:44下载
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  • hdlc
    hdlc协议的封装与解析,fsc校验,完整的例程代码(Decode and Encode an HDLC packet ,using FCS16 calculation)
    2015-09-21 11:20:55下载
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  • LIP6903CORE_CSC_RGB2YUV
    CSC RGB2YUV Verilog source code
    2011-02-28 20:06:13下载
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  • paper7
    分数阶Unscented卡尔曼滤波器研究.pdf(Fractional Unscented Kalman filter pdf)
    2012-12-27 21:00:41下载
    积分:1
  • LineBuffer
    此代码由 Altera 演示,并已对其进行修改(版权所有 ︰ Altera)
    2022-03-20 04:11:56下载
    积分:1
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