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加法器和乘数

于 2022-05-20 发布 文件大小:2.87 kB
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代码说明:

不同类型的加法器和乘法器在 verilog 中实现。这些都是: 携带看加法器,carryskip 加法器,booth 型乘法器,阵列乘法器

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  • 组合下载器SCH-3-RENEW
    说明:  有自己制作的下载器原理图,包含了stlinkv2,XDS100V3,USBBLASTER.原理图和封装,一款多功能下载器。(Have their own production downloader schematic diagram, contains stlinkv2, XDS100V3, USBBLASTER. Schematic diagram and encapsulation, a multi-function downloader.)
    2019-02-28 17:27:16下载
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  • package_control-master
    从github下载的,能够参考设计AXI4的协议接口(AXI4 Verilog template)
    2019-03-30 16:14:05下载
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  • FPGA中VGA接口
    基于 FPGA的 VGA 接口的实例,在这里,我们先要考虑 vga_interface.v 支持的图像分辨率,亦即 16x 16 。所以 RAM 所需要的储存空间是 16Bits x 16Words。RAM 和 FIFO 一样,要访问 RAM 的时候都需 要拉高 xx_En_Sig 信号。由于RAM 包含 16Bits 所以 Write_Data 和 Read_Data, 皆 是16 位的位宽。当然,16Words 表示了 xx_Addr_Sig 是 4位的位宽。
    2022-12-04 02:40:07下载
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  • vending-machine
    用Verilog实现自动售货机功能,代码较初级。易懂,内含test文件。(Automatic vending machines function with Verilog code than the primary. Understandable, containing test files.)
    2013-11-30 20:25:34下载
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  • 4位BCD计数器
    用Verilog语言编程实现4位BCD计数器的功能(Write the programm with Verilog language to implement the function of 4 - bit BCD counter.)
    2020-11-30 13:49:27下载
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  • ZEDBOARD
    说明:  ZEDBOARD的管脚分配图和约束文件,包括PCB图和xdc文件(Pin assignment of ZEDBOARD)
    2021-03-23 21:19:15下载
    积分:1
  • ahb_sram
    ahbsram contains all codes of sram
    2019-04-27 21:25:52下载
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  • 多周期CPU设计完整代码,可以直接跑
    多周期CPU设计的全部完整代码,下载之后可以直接跑,实验课作业,已经通过检查,没有啥毛病。
    2022-07-25 06:53:59下载
    积分:1
  • Synthesis_and_Fpga_Implementation_of_UAR
    Synthesis and fpga implementation of UART
    2018-12-03 14:06:02下载
    积分:1
  • MD5
    哈希算法FPGA实现代码,采用MD5算法,并给出了仿真波形。(MD5 hashing algorithm for FPGA implementation code)
    2020-07-03 00:40:02下载
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