-
design of 8 point fft
本课题描述了基于fpga的32点fft的设计。这里进行verilog编码来实现这个32点fft。使用xilinx ise 12.1版本进行合成和模拟；
- 2022-09-16 13:55:03下载
- 积分：1
-
verilog
数字信号除了的FPGA实现的Verilog源代码，之前发过一份是VHDL，各有所需吧，需要的看看吧(Digital signal in addition to the realization of the FPGA Verilog source code, send before a is VHDL, each have need it, need to look at it
)
- 2012-02-25 15:06:35下载
- 积分：1
-
4位并行的32位 CRC校验
此程序为32位的CRC校验程序，我们利用verilog语言较容易的编写串行的CRC校验程序，但是在一些情况下需要并行的处理数据，在此编写了4位并行的CRC校验程序。
包括了CRC主程序和测试程序。
- 2022-03-05 13:25:41下载
- 积分：1
-
sixlift
一个数字电路设计：六层电梯自动运行的VHDL程序(a digital circuit:sixlift design)
- 2013-05-02 19:31:59下载
- 积分：1
-
R_I_CPU
学校实验，用Verilog实现的单周期CPU,分别实现I型、R型、指令，使用的工具为ISE(School experiments, using Verilog to achieve a single cycle CPU, respectively, to achieve I type, R type, instruction, the use of tools for ISE)
- 2018-06-11 16:38:10下载
- 积分：1
-
基于FPGA和matlab的IIR滤波器设计
基于FPGA和matlab设计的IIR滤波器，利用matlab的simulink工具进行设计，包含了源码和相关文档说明，希望能够对大家有所帮助
- 2022-04-02 06:35:36下载
- 积分：1
-
memristor
忆阻器的PSPICE仿真，是忆阻器的宏模型，适合于cadence16.5版本(memristor PSPICE simulation)
- 2021-02-20 09:39:43下载
- 积分：1
-
dds32_1
说明： 频率合成器实例模块设计。频率分辨率为32位DDS的VHDL程序(Frequency synthesizer module design example. 32-bit DDS frequency resolution of the VHDL program)
- 2011-04-14 13:45:22下载
- 积分：1
-
卷积编码器217conv(171,133)
卷积编码器217,已验证， conv(171,133)
x1=1+d+d^2+d^3+d^6
x2=~(1+d^2+d^3+d^5+d^6)
- 2022-03-24 06:03:28下载
- 积分：1
-
8-fft
FFT 8 PT RDX 2 USING VERILOG
- 2014-03-31 02:35:31下载
- 积分：1
