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试验台的 cavlc entrope 解码器

于 2022-01-23 发布 文件大小:1.51 kB
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  • TLC1620
    基于FPGA的Verilog语言实现的六十进制计数器(FPGA-based Verilog language implementation of six decimal counter)
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  • Verilog入门
    本文主要介绍了Verilog HDL 语言的一些基本知识,目的是使初学者能够迅速掌握HDL          设计方法,初步了解并掌握Verilog HDL语言的基本要素,能够读懂简单的设计代码并能          够进行一些简单设计的Verilog HDL建模。  缩略语清单:对本文所用缩略语进行说明,要求提供每个缩略语的英文全名和中文解释。  参考资料清单:请在表格中罗列本文档所引用的有关参考文献名称、作者、标题、编号、发布日          期和出版单位等基本信息。
    2022-06-30 05:00:17下载
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    此代码是由FPGA产生SPWM波的代码,简单易懂(use FPGA to generate SPWM)
    2019-02-19 16:12:33下载
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    资源描述关于PI数字控制的基本思想,和具体实现。。
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  • DDS
    FPGA实现DDS波形发生器,多种信号的产生,(FPGA realization of DDS waveform generator to produce a variety of signals,)
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  • FIR 滤波器加速器
    Nios II 处理器上运行的 FIR 滤波器加速器
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    对赛灵思7系列的三种型号的FPGA进行了综述(xilinx 7 productin overview)
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  • 异步fifo
    常用的异步FIFO empty full 标志位 读出剩余usedrd 写入数量usedwr
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