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DDS信号发生器

于 2023-06-06 发布 文件大小:102.88 kB
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代码说明:

描述了verilog实现的DDS信号发生器,可以经过FPGA验证,包括了代码实现以及书写。代码可以经过altera的EDA工具进行了验证,可以实现信号发生器的基本功能。希望大家珍惜,并好好学习。描述了verilog实现的DDS信号发生器,可以经过FPGA验证,包括了代码实现以及书写。代码可以经过altera的EDA工具进行了验证,可以实现信号发生器的基本功能。希望大家珍惜,并好好学习。描述了verilog实现的DDS信号发生器,可以经过FPGA验证,包括了代码实现以及书写。代码可以经过altera的EDA工具进行了验证,可以实现信号发生器的基本功能。希望大家珍惜,并好好学习。

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  • CCMU
    代码是一个复数乘法器,两个复数相乘,只用到了2个实数相乘,运算量少(Code is a complex multiplier, two complex multiplication, uses only real number multiplied by 2, operations less)
    2011-11-04 11:56:47下载
    积分:1
  • CfgDDS_9910
    dds ad9910配置的verilog hdl程序,模块化设计,输入待配置的数据,字长,启动信号,即可自动产生时序,完成一次配置,模块还有done握手信号,方便用户调用时,反复多次配置。(dds ad9910 configuration verilog hdl program, modular design, the input data to be configured, word length, the start signal, the timing can be automatically generated, complete a configuration, the module has done handshake, user-friendly call, repeatedly configuration .)
    2015-04-21 22:03:50下载
    积分:1
  • nor_flash_verilog
    fpga verilog实现 S29GL256S 系列 并行 nor flash 的读写擦除操作功能。 verilog源代码。(Verilog S29GL256S to achieve FPGA series parallel flash nor read and write erase operation function. Verilog source code)
    2021-04-15 16:18:54下载
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  • Taxi-automatic-billing
    出租车自动计费系统的verilog程序代码(Taxi automated billing system verilog code)
    2009-10-08 10:07:15下载
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  • scia_loopback_interrupts
    TI F28027 SCI 源码,中断,FIFO,LoopBack使能(TI F28027 SCI source code, interrupt, FIFO and Loopback enalbe)
    2020-11-18 15:29:40下载
    积分:1
  • ps2_interface
    封装PS2接口驱动,用verilog编写!适用于键盘,鼠标等PS2接口的器件。(failed to translate)
    2013-05-05 10:48:42下载
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  • PipelineCPU_5stage_verilog
    管道 CPU 与 5 阶段: 如果、 ID EX MEM,WB。每个模块都有一台试验。它包含一个整个的 ISE 项目。您可以直接运行它。ROM 模块已预先存储指令作为一个实例。
    2022-07-17 12:45:49下载
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  • 67_ellipf
    vhdl very good debug release vhdl very good debug release
    2006-10-22 18:39:48下载
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  • 二极管的hspice模型代码
    基于verilog-a的自建模型,可以作为任何代建模型的参考,理解hspice模型的构成,内在根本机理。
    2022-05-26 08:04:18下载
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    2023-02-23 11:10:03下载
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