登录
首页 » VHDL » CGRA加密算法可重构

CGRA加密算法可重构

于 2023-05-25 发布 文件大小:73.42 kB
0 34
下载积分: 2 下载次数: 1

代码说明:

工作机制如下: 1、 系统上电,配置信息由片外加载到片上配置存储器中; 2、 执行某算法前,将此算法所有的配置包写入到配置包存储器中(配置包存储器包含在配置解析单元中); 3、 配置解析单元解析配置索引,从配置存储器中选择相应的配置对可重构阵列及功能模块进行配置; 4、 阵列从外部中读取数据进行计算,计算结果写出到密文寄存器中; 5、 可重构阵列与功能模块计算的中间结果数据只与通用寄存器堆进行交互; 6、 阵列计算的中间结果通过通用寄存器堆缓存;

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • sram_test_OK
    主要是基于FPGA(EP2C8Q208I8)下的SRAM驱动,SRAM型号为IS61LV25616,程序语言为Verilog,开发环境为quartusII 7.0,为一工程,可直接下载到FPGA中,含电路图(Mainly based on FPGA (EP2C8Q208I8) driving under the SRAM, SRAM model IS61LV25616, programming language for Verilog, a development environment for quartusII 7.0, for a project, can be downloaded directly to the FPGA, including circuit diagrams)
    2014-12-24 22:08:36下载
    积分:1
  • Time_setting
    时间设置 可以作为设计中的一个小模块进行使用 方便快捷(time setting)
    2012-03-30 10:12:28下载
    积分:1
  • 8051IP nuclear source code (VHDL). RAR
    8051IP 核源代码(VHDL).RAR-8051IP nuclear source code (VHDL). RAR
    2022-11-14 08:05:04下载
    积分:1
  • 用VHDL编写的串口通讯程序,包括几个不同的程序例子,也可以用verilog进行改写。...
    用VHDL编写的串口通讯程序,包括几个不同的程序例子,也可以用verilog进行改写。
    2023-09-04 22:05:02下载
    积分:1
  • Using VHDL realize CPLD (EPM240T100C5) output of the VGA screen
    利用VHDL实现CPLD(EPM240T100C5)的VGA屏幕输出-Using VHDL realize CPLD (EPM240T100C5) output of the VGA screen
    2023-04-13 10:15:04下载
    积分:1
  • VHDL设计的功能齐全的交通灯程序,经过仿真一切功能符合要求。...
    VHDL设计的功能齐全的交通灯程序,经过仿真一切功能符合要求。-VHDL
    2022-01-25 23:26:36下载
    积分:1
  • 这本电子书电子hobbiest。
    this ebook for electronics hobbiest. VHDL for Beginners
    2022-02-01 14:25:13下载
    积分:1
  • adc_cfg
    说明:  adc器件ads62p49配置代码,已在工程中验证可用(Temperature sensor DS18B20 parses the code, has verified the ADC device configuration code, has been verified available)
    2020-11-04 16:29:51下载
    积分:1
  • svpwm3
    说明:  基於空間向量調變的開關法,在於載波做比較切出方波再送至開關讓馬達啟動(Based on the switching method of space vector modulation, the square wave is cut out for carrier comparison and sent to the switch to start the moto)
    2019-01-04 16:07:37下载
    积分:1
  • pdf
    说明:  一种基于FPGA的调频连续波方位向多通道 FMCW SAR的实时成像信号处理方法及FPGA,包 括:步骤一、计算重构矩阵;步骤二、重构方位向 多通道数据,包括:步骤2 .1、对各个通道的回波 数据沿方位向分别间隔补零,并进行方位向傅里 叶变换;步骤2 .2、将方位向傅里叶变换之后各个 通道方位向相同位置的点组合为一个向量并与 重构矩阵相乘,得到重构完成的方位向数据;(An azimuth multichannel FMCW based on FPGA FMCW SAR real-time imaging signal processing method and FPGA, package Including: Step 1: calculate the reconstruction matrix; step 2: reconstruct the orientation Multichannel data, including: step 2.1, echo of each channel The data is compensated with zero along the azimuth direction respectively, and the azimuth Fourier is carried out Step 2.2, after the azimuth Fourier transform The points of the same position in the channel azimuth are combined into a vector and are connected withThe reconstruction matrix is multiplied to get the reconstructed azimuth data Step 2.3. Repeat step 2.3 for the data of different distance gates)
    2020-02-07 19:47:41下载
    积分:1
  • 696518资源总数
  • 104297会员总数
  • 29今日下载