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DDS
基于ARM的DDS信号发生器设计,可以产生各种信号的波形,生成所需要的信号,可供实验用(DDS signal generator based on ARM, can produce a variety of signal waveform can be used for experiment)
- 2013-03-29 18:49:52下载
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APB 2.0 Master
- 2022-03-12 21:40:55下载
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modbus_latest.tar
modbus的fpga实现。opencores上最新版本。使用fpga实现,可以大大提高响应速度,对其功能进行模块化。(modbus of fpga implementation. opencores the latest version. Use fpga implementation, can greatly improve the response speed, its function modularity.)
- 2020-10-22 10:37:23下载
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乘数 2 位数 4 位
这是乘数 2 位数 4 位,第 4 部分实验室 6-行使的 Altera DE2 工具包的解决方案
乘数包括 2 位数 4 位输入,我使用的开关SW11−8 代表人数A 和交换机SW3−0 来表示 B.的十六进制值 A 和 B 都要上 7 段显示显示 HEX6 和 HEX4, 分别。结果 P = × B 是要显示在HEX1和HEX0上。
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- 2022-07-05 01:13:31下载
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pipline_lms_and_rls_verilog
流水线LMS,和RLS算法的Verilog代码,用于自适应信号处理的FPGA实现。(The Verilog code about fir_pipline_lms and fir_rls. They commonly used in adaptive signal processing in FPGA platform.)
- 2021-05-06 20:58:37下载
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数字秒表的设计
设计一个秒表,系统时钟选择时钟模块的1KHz,由于计时时钟信号为100Hz,因此需要对系统时钟进行10分频才能得到,之所以选择1KHz的时钟是因为七段码管需要扫描显示,所以选择1KHz。另外为了控制方便,需要一个复位按键、启动计时按键和停止计时按键,按下复位键,系统复位,所有寄存器全部清零;按下开始键,秒表启动计时;按下停止键,秒表停止计时,并且七段码管显示当前计时时间,如果再次按下开始键,秒表继续计时,除非按下复位键,系统才能复位,显示全部为00-00-00。
- 2022-02-07 06:46:24下载
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DE2_115_Synthesizer
FPGA implementation of simple Multi-tone Electronic Keyboard using DE2-115 board with a PS/2 keyboard and speaker
- 2013-08-20 19:48:32下载
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mmuart
简单uart,verilog语言编写,已经经过测试,有需要的可以看看(Simple uart, Verilog language, has been tested, you can see if you need it)
- 2020-06-23 20:00:01下载
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fir滤波器
用matlab中工具fdatool生成一个低通滤波器,将滤波器系数量化。仿真通过,通带2.5兆,截止频率5M。
- 2022-03-20 06:42:57下载
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pong_C5H
FPGA的经典例程,可以进行移植和借鉴使用(FPGA' s classic routines, can be transplanted and learn to use)
- 2011-07-23 10:15:41下载
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