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A useful practical VHDL Tutorial, it is suitable for beginners to learn, introdu...

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代码说明：

一个很有用的vhdl实用教程，很适合初学者学习，介绍了vhdl的一些基本概念，还有一些经典的实例。-A useful practical VHDL Tutorial, it is suitable for beginners to learn, introduced some basic concepts of VHDL, there are some classic examples.

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VendingMachine
VHDL Vendingmachine source

2013-11-02 06:19:46下载

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七人表决器
七人表决器，当有四人或四人以上的人同意是，表决通过。每个裁判控制一个开关，高电平表同意，在quartusII上用全加器来实现，当表决通过时，实验箱上的LED灯亮

2022-02-03 05:43:46下载

积分：1
ANALYSIS-OF-ALL-GATES
ANALYSIS OF ALL GATESS

2013-11-12 13:33:55下载

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LM
说明：用于生成adams或recurdyn所需的路面不平度，用于悬架或其他的仿真(Adams or recurdyn used to generate the required road roughness for suspension or other simulation)

2013-10-15 17:38:48下载

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UART(RS232)
用VERILOG语言实现的通用异步串行收发器（RS232收发器），波特率可设置，通讯稳定，已成功应用于实际项目。(VERILOG language with universal asynchronous serial transceivers (RS232 transceiver), the baud rate can be set, communication stability, has been successfully applied in actual projects.)

2021-04-01 10:59:08下载

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m_ca7
verilog编写的基于CA算法的m序列发生器，其中验证了多种CA系数来实现m序列。(CA-based algorithm written in verilog m-sequence generator, which verify the CA factor to achieve a variety of m-sequence.)

2011-10-26 14:33:59下载

积分：1
loop
对锁相环路的仿真，二阶环的仿真与分析都可以通过这个文件来到完成(Simulation of PLL, second-order loop simulation and analysis can be completed by the adoption of the document came)

2008-12-17 23:00:35下载

积分：1
计算机体系结构手册上的Verilog HDL
Computer Architecture Handbook on Verilog HDL

2022-03-21 17:37:14下载

积分：1
Fractional_Time_Delay
Used for Time shifting discrete signals, it can do both integral and fractional sampling period delay. Original.

2020-12-16 22:29:12下载

积分：1
Altera FPGA IP core of the source code for the use of Altera FPGA design to prov...
ALTERA的FPGA的IP核的源代码,为使用ALTERA的FPGA的相关设计提供参考.-Altera FPGA IP core of the source code for the use of Altera FPGA design to provide the relevant information.

2022-04-30 06:15:53下载

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