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Implementing a TMDS Video Interface in the Spartan-6 FPGA

于 2022-10-21 发布 文件大小:47.95 kB
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代码说明:

This application note describes a set of reference designs able to transmit and receive DVI and HDMI data streams up to 1080 Mb/s using the native TMDS I/O interface featured by Spartan-6 FPGAs.

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  • CLOCK1027
    设计了一个电子时钟,功能包括定点报时,设置闹钟,校时等(Designed an electronic clock, features include fixed-point timekeeping, setting alarms, school hours, etc.)
    2018-07-01 18:11:41下载
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  • 直方图均衡化fpga实现
    在fpga上实时实现图像的直方图均衡化,有效利用fpga芯片的片内资源,不需要添加片外的存储芯片。本代码是基于ycbcr处理的,其实只对亮度分量进行直方图均衡化,之后同步cb,cr颜色分量,避免偏色问题!代码接口为y,cb,cr,以及行场信号,hs,vs,de.最终的处理效果可以达到在pc机上的效果,但是比pc块很多,几乎可以实时完成处理
    2023-06-23 11:20:03下载
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  • 74ls165
    74ls165电路源代码verilog,已经验证。(74ls165 verilog)
    2020-11-22 22:59:34下载
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  • PS2_kebord_controller
    PS2键盘控制器的VHDL源码,用FPGA直接读取键盘的输入并显示。(PS2 keyboard controller VHDL source code, with a direct FPGA to read keyboard input and displayed.)
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  • Lab12:4位移位寄存器的的设计与实现
    如题所属,简单实现了所需要的4位移位寄存器的功能,简单明了。实现的方式是直接用时钟控制周期,不断循环,根据最后一位的数据不断前移产生的字串系列。需要注意的是时钟的频率太高,需要很大的降频控制才能达到1秒左右的移位周期,修改时请注意。本实验作为实验系列第12个出现,更多详情敬请期待。
    2022-08-21 09:13:05下载
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  • 8B_10BENCODER
    基于8B10B的编解码模块的设计,使用verilog HDL语言,具有实用价值。(8B10B encoder)
    2014-05-23 16:39:25下载
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  • 08_4_hdmi_loop
    说明:  HDMI做为视频输出输入接口已经广泛使用很长时间,主要通过TMDS差分编码传输。本实验通过在HDMI屏幕上显示彩条和输入输出环通实验,来练习视频的时序和视频颜色的表示,为后面视频处理实验做个基础。(HDMI as video output input interface has been widely used for a long time, mainly through TMDS differential coding transmission. In this experiment, by displaying color bars and input/output loop experiments on HDMI screen, video timing sequence and video color representation are practiced to lay a foundation for video processing experiments later)
    2020-06-17 09:00:02下载
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  • vbyuanma
    示波器的源码,基于串行口的,(oscilloscope source code, based on the serial port,)
    2007-04-18 19:11:22下载
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  • VGA256显示verilog程序
    本程序是VGA256色方块显示的verilog HDL代码,包括XILINX系列virtex5 FPGA芯片的约束程序,用相应的板子连上VGA接口到显示屏上可以实现显示,显示分辨率1024×768,包括行场同步信号消隐程序、有效区域显示和256色VGA显示程序,代码安全可靠。
    2022-05-20 16:37:03下载
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  • 4位Verilog计数器代码
    Verilog最基本的源代码之一,位宽为4的二进制计数器。既可以实现计数也可以实现对时钟信号的分频,因此是Verilog入门非常实用的代码之一。在此代码基础之上,可以进行多种改变,实现不同的功能。
    2022-01-21 19:54:42下载
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