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fpga的模拟信号发生器

于 2022-09-19 发布 文件大小:3.41 MB
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代码说明:

这是基于FPGAD的DDS(直接数字式频率合成器)信号发生器,使用的语言是硬件描述语言(Verilog),通过使用matlab生成的.mif文件,加载到ROM,IP核中,通过语言描述,可以产生频率和相位可调的模拟波形信号

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