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verlog hdl brushless motor control procedures have been in ModelSim Simulation
verlog hdl无刷电机控制程序,已在modelsim仿真-verlog hdl brushless motor control procedures have been in ModelSim Simulation
- 2022-03-25 00:10:35下载
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VHDL-for-engineers
本书比较系统地介绍了VHDL 的基本语言现象和实用技术全书以实用和可操作
为基点简洁而又不失完整地介绍了VHDL 基于EDA 技术的理论与实践方面的知识
其中包括VHDL 语句语法基础知识第1 章第7 章逻辑综合与编程技术第9 章
有限状态机及其设计第10 章基于FPGA 的数字滤波器设计第11 章多种常用
的支持VHDL 的EDA 软件使用介绍第12 章VHDL 数字系统设计实践介绍第13
章和大学生电子设计赛题的VHDL 应用介绍第14 章全书列举了大量VHDL 设
计示例其中大部分经第12 章介绍的VHDL 综合器编译通过第13 章的程序绝大部分
都通过了附录介绍的EDA 实验系统上的硬件测试可直接使用书中还附有大量程序
设计和实验/实践方面的习题
本书可作为高等院校的电子工程通信工业自动化计算机应用技术电子对抗
仪器仪表数字信号处理图像处理等学科领域和专业的高年级本科生或研究生的VHDL
或EDA 技术课程的教材及实验指导也可作为相关专业技术人员的自学参考书(VHDL for engineers)
- 2013-10-29 09:33:59下载
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VHDL实现二维DCT变换
本程序利用VHDL实现二维离散余弦变换，经本人测试，在Quartus II7.0软件上可正确仿真，希望大家积极采纳
- 2022-02-06 07:06:17下载
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FPGA
基于FPGA的频率相位可调DDS信号发生器-FPGA-based phase adjustable frequency DDS signal generator
- 2022-01-26 08:17:52下载
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implementation of fft core using vhdl
本文件是作为超大规模集成电路设计实验室课程（EC354）一部分进行的为期一学期的项目报告。我们的项目是一个4位8点FFT（快速傅立叶变换）核心的完全定制设计。实现的FFT类型是DIF（时间抽取）FFT。
- 2022-04-11 10:12:02下载
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steper motor
stepper motor module on spartan 6 and 24MHz clock fequency
- 2019-03-10 15:44:31下载
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xmatchpro无损压缩
应用背景这个无损数据压缩系统的xmatchpro算法 衍生物；从来源 ； ；以前的研究 ； ；的 ； ；作者 ；和 ；在进步 ； ；FPGA技术。使用这种技术提供的灵活性是非常大的兴趣，因为芯片可以容易适应特定应用的要求。这个在一定的弊端； ； ； ；以前的 ；方法是 ； ；克服了 ； ；使用 ； ； xmatchpro ；算法；设计。的目标，然后以获得更好的压缩比，并仍然保持高吞吐量和高吞吐量，因此，这和，压缩/解压缩和，过程和，不，不，慢和，原系统的。关键技术UNIX的 ； ；实用 ；“压缩” ；采用lempel-ziv-2 ； ； ；（LZ2）算法和 ； ； ；数据Lempel-Ziv压缩 ； ； ；（dclz）的家庭 ； ；压缩机 ；最初发明 ； ；的 ；休利特—目前帕卡德和 ； ；& nbsp；通过开发 ； ；啊哈[ 17 ]，[ 18 ] ；使用也 ； ；LZ2 ；衍生物。邦顿 ；和 ；博列洛 ；另一本 ； ；LZ2 ；在实施 ； ；[ 19 ] ；， ；提高 ；在 ；数据压缩Lempel-Ziv算法。
- 2022-04-09 16:54:49下载
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该项目是用于执行4位arethmatic操作和逻辑操作…
The project is used to perform the operation of 4 bit arethmatic and logical operation. the projcet is implemented in spartan 3E
- 2022-03-21 15:49:24下载
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I2C控制器源代码，Verilog HDL语言，可以直接调用
I2C控制器的源代码，Verilog HDL语言编写，可以直接调用-I2C controller source code, Verilog HDL language, you can directly call
- 2023-04-28 04:45:03下载
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VHDL实现SPI功能源代码
VHDL实现SPI功能源代码
-- The SPI bus is a 3 wire bus that in effect links a serial shift
-- register between the "master" and the "slave". Typically both the
-- master and slave have an 8 bit shift register so the combined
-- register is 16 bits. When an SPI transfer takes place, the master and
-- slave shift their shift registers 8 bits and thus exchange their 8
-- bit register values.-SPI realize the functional VHDL source code The SPI bus is a 3 wire bus that in effect links a serial shift register between the
- 2022-01-26 00:50:40下载
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