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8-解码器 FPGA

于 2022-08-17 发布 文件大小:1.03 kB
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代码说明:

8 位解码器使用 verliog,fpga,使用 verliog,fpga,使用 verliog,fpga,使用 verliog,fpga,使用 verliog,fpga,使用 verliog,fpga,使用 verliog,fpga,使用 verliog 的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯的8 位解码器上的 led 指示灯fpga, 8 位解码器使用 verliog,fpga 上的 led 指示灯上的 led 指示灯

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  • shumagua
    通过数码管和单片机的组合 制作成的数码管时钟程序(Through the combination of digital control and made ​ ​ into a single-chip digital clock program)
    2013-10-27 12:30:04下载
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  • 基于VERILOG的序列检测器
    利用状态机编写一个序列检测器,可以依照思路修改需要检测的序列!
    2022-07-06 09:27:08下载
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  • ds18b20 verilog 驱动
    这是完整的verilog控制ds18b20的程序,已在板子上运行了很长时间,很稳定,200M以下时钟皆可稳定运行(我是按照200M来设计的),上传的文件格式为.dat(在此不说明原因),下载后修改后缀名为.v即可使用,我也是为了积分才上传的,绝对可信,
    2022-08-21 20:48:37下载
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  • ATAN_CORDIC
    使用cordic算法,基于verilog实现的atan功能,经过仿真验证,适宜工程使用。(ATAN,implemented with cordic.)
    2018-09-26 11:19:50下载
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  • Xilinx vivado authoritative course
    说明:  Xilinx vivado 权威教程,清华大学出版社出版,何宾编著。(Xilinx vivado authoritative course, published by Tsinghua University Press, edited by He Bin.)
    2019-02-19 20:37:09下载
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  • 余数数制系统
    反向转换器模量集 {2n + 1、 2n、 2n 1} 提出了。中国剩余定理的简化 为了获得一个反向转换器的使用 mod-{2n-1} 操作。这里的显式使用模量的负担将被丢弃。这些反向转换器用来寻找乘法逆的 RNS 价值。为了限制我们使的范围使用中提出的变换器和最好的相当先进的转换器 cyclone2 fpga 基数 8 展位修改 rns 乘法器。当比较其他转换器此体系结构可节省电力、 地区、 延迟和成本降低
    2022-02-05 02:53:51下载
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  • LED
    按键控制数码管显示,从0到9显示,八位数码管(Button control digital tube display)
    2017-11-13 20:19:42下载
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  • a
    用verilog实现除法器,调用了ip核,不仅有源代码,还有测试程序的时序编写(verilog ise divider)
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  • USB2.0的IP核(详细verilog源码和文档)
    USB2.0的IP核开发.代码可以直接使用已经验证过(USB2.0 IP kernel development. Code can be used directly, has been verified)
    2020-12-24 18:49:04下载
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  • 关于 NIOII IO 与沟通
    我有一个完整的项目 CPU Nios II 与 IO 设备之间如何进行通信: 我用 32 开关: [31:0] 作为输入设备进行通信与加利福尼亚 Nios2.And 后我使用 31 红色的 led 指示灯显示输入从开关的值。 我希望我可以帮助您了解有关与 CPU Nios2 IO 设备之间进行通信,这是一个例子,您可以开发遵循你的目的 !
    2022-09-20 20:25:07下载
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