登录
首页 » Verilog » Verilog 的展位乘数

Verilog 的展位乘数

于 2022-07-26 发布 文件大小:236.88 kB
0 65
下载积分: 2 下载次数: 1

代码说明:

我们要提出新的 SRAM bitcell 以较少的功率消耗,读稳定性、 面积小于现有的施密特触发器基于 SRAM 和其他现有的设计,通过新的设计相结合的虚拟接地与读取错误减少逻辑。 可调滞回 CMOS 施密特触发器 磁滞 CMOS 施密特触发器设计策略研究了电压控制电流下沉和/或采购晶体管,迟滞窗口可以轻松地移动而不更改其宽度。对 ST 反馈逆变器进行了修改,晶体管被绊倒的逻辑 "0" 和 "1" 的逻辑。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • ATSHA204_SHA256HMAC
    ATSHA204_S加密芯片资料,学习使用该芯片必读资料(ATSHA204_S encryption chip data, required reading for learning to use the chip)
    2013-09-22 10:34:43下载
    积分:1
  • clock-generation
    长帧同步时钟的产生, 源码程序,实验好用(Long frame synchronization clock generation, source program, easy to use experimental)
    2012-10-21 09:52:08下载
    积分:1
  • STM32F10x几种功能demo
    STM32F107几种功能demo:串口,定时器,外部中断,systick,看门狗等实例
    2022-03-21 00:47:07下载
    积分:1
  • ssb
    ssb的调制与解调,包括信号的产生、乘法器、加噪、BPF、解调等部分。(ssb modulation and demodulation, signal generation, multiplier, adding noise, BPF, demodulation section.)
    2013-04-11 16:02:10下载
    积分:1
  • 实现16位可逆逻辑ALU 15作业设计
    应用背景可逆逻辑是一种新兴技术,具有广阔的应用前景,在量子计算。该项目将处理16位可逆算术逻辑单元(ALU)的设计与15  ;操作是提出了利用双佩雷斯门,Fredkin门,toffolli门,DKG闸门与非门。提出了一种新的ALU利用可逆逻辑大门的VLSI结构。ALU是最重要 ;组件的CPU,可以是一个可编程的可逆计算设备,如量子计算机的一部分。& nbsp;第一单位可逆的ALU和第二单位ALU是设计然后16个单位ALU的 ;级联在一起以开展ALU执行LSB操作输入进位ALU执行下一 ;LSB运行。设计和实施在Xilinx 14.4 Verilog验证关键技术众所周知,穆尔的法律将停止功能,更快的东西,因此,有戏剧性的,因此,在微电子领域在不久的将来发生。更快和更复杂的数字系统的建设,电力 ;CMOS电路的功耗已经成为一个备受关注的问题。兰道尔证明,功率损耗是一个完整功能的不可逆电路信息损失 ;不论技术的电路是实现。& nbsp;同时,贝内特显示,为了保持电路耗散功率,它已经由 ;可逆盖茨。可逆电路(大门),有相同数量的输入和输出,有一对一的 ;输入和输出向量的映射关系。因此,输入状态的向量,可以总是唯一的重建,从输出状态的向量。因为没有可逆的概念,真正的低功耗电路不能建立逻辑,各种技术和电路的可逆逻辑最近正在研究。算术逻辑单元(ALU)本质上是一个CPU的心。这允许计算机添加,减去,和执行基本的逻辑运算,例如,或等,因为每一台计算机需要能够做到这些简单功能,它们总是包含在一个处理器中。ALU是组合逻辑电路,可以有一个或多个输入只有一个输出。ALU的输出取决于输入施加在那一瞬间,作为时间的函数,和不在过去的条件。其基本形式是一个简单的ALU的操作数输入,选择输入结果所需的操作和一个输出。ALU的复杂性可能会有所不同从处理器。在一个二进制算术和逻辑运算的可逆三ALU是基础设计。在目前的工作 ;15操作16位ALU设计。
    2022-11-19 17:20:04下载
    积分:1
  • baugh wooley codes
    这是用于阵列乘法器baugh wooley 。这是写Verilog代码。它表明8位阵列乘法。这是输入含有8,8每输出有15位
    2023-06-03 10:00:03下载
    积分:1
  • TugasUAS_AuditTI_1504505017_Reguler
    说明:  ertyguhijop[lkjhvbn hiouopi][[poiuy
    2019-02-05 09:18:23下载
    积分:1
  • ba_ker
    巴克码装到信息内同时将巴克码识别出来,实现帧同步的VHDL设计(Barker code loaded to the information identified while Barker code, VHDL design to achieve frame synchronization)
    2014-05-18 17:37:39下载
    积分:1
  • 4位Verilog计数器代码
    Verilog最基本的源代码之一,位宽为4的二进制计数器。既可以实现计数也可以实现对时钟信号的分频,因此是Verilog入门非常实用的代码之一。在此代码基础之上,可以进行多种改变,实现不同的功能。
    2022-01-21 19:54:42下载
    积分:1
  • 防盗灯verilog
    利用XC9572-PQ44(Xilinx CPLD)制作的一款家用防盗报警器的Verilog源代码及原理图,当房门打开后,15秒内若没有按下Key1,则会自动拨打设定手机号(当然,要另连接一台手机)
    2022-01-26 14:59:55下载
    积分:1
  • 696518资源总数
  • 104388会员总数
  • 18今日下载