登录
首页 » VHDL » UDP / IP上的Spartan3E以太网通信

UDP / IP上的Spartan3E以太网通信

于 2022-06-20 发布 文件大小:178.50 kB
0 53
下载积分: 2 下载次数: 1

代码说明:

UDP / IP上的Spartan3E以太网通信通过斯巴达3E发送UDP数据包到/从我的电脑。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • SineGen
    Basic VHDL code to create a sine wave generator for an FPGA board.
    2014-01-24 01:04:15下载
    积分:1
  • 免费8051核心上传
    Free 8051 core upload
    2022-02-21 19:18:14下载
    积分:1
  • VHDL_PS2
    Spartan3e keyboard ps2
    2010-01-28 18:38:40下载
    积分:1
  • dac9747
    主要完成ADI公司的DAC(数字-模拟转换器)AD9747的SPI接口及寄存器配置(Mainly to complete ADI' s DAC (digital- analog converter) SPI interface to configure the AD9747 and the register of)
    2014-06-03 11:00:43下载
    积分:1
  • 模糊控制器verilog程序代码
    说明:  模糊控制器verilog程序,模糊控制器最简单的实现方法是将一系列模糊控制规则离线转化为一个查询表(又称为控制表)。这种模糊控制其结构简单,使用方便,是最基本的一种形式。(Verilog program of fuzzy controller)
    2020-04-14 12:04:52下载
    积分:1
  • FFT_verilog
    说明:  verilog实现的FFT变换,经硬件测试其功能与Altera的FFT IP核相近(verilog implementation FFT transform, through hardware, test its functionality with Altera' s FFT IP core similar to)
    2009-08-26 11:29:57下载
    积分:1
  • 正弦信号发生器(可扫频)通过验证 正弦信号发生器
    正弦信号发生器(可扫频)通过验证 正弦信号发生器-Sinusoidal signal generator (which can be swept) through the validation of sinusoidal signal generator
    2022-04-10 22:34:24下载
    积分:1
  • 本程序为24小时计时器,稳定无误差。简单好用,是Verilog HDL语言初学者的指引。...
    本程序为24小时计时器,稳定无误差。简单好用,是Verilog HDL语言初学者的指引。-This procedure for 24-hour timer, stable error-free. Easy-to-use, is the Verilog HDL language beginners guide.
    2022-07-20 09:46:32下载
    积分:1
  • shuzihongdianlu
    数字钟电路的实现,可以24小时计时,可调整时间!(Digital clock circuit implementation, a 24-hour timer, adjustable time!)
    2013-08-18 14:49:14下载
    积分:1
  • controller
    说明:  alu control 控制 部件 alu control 控制 部件(alu control)
    2010-04-30 10:55:26下载
    积分:1
  • 696518资源总数
  • 104297会员总数
  • 29今日下载