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CPU课程设计报告

于 2022-05-30 发布 文件大小:11.35 MB
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代码说明:

题目来源于学校的课题系统硬件综合设计,代码中有单周期CPU设计,多周期流水线CPU设计,使用的是Verilog语言,多周期的是基于MIPS架构。

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  • LAB22
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    按照手册驱动线阵CCDTCD1209和AD9945,驱动频率10M,板卡时钟30MHz,经PLL分频后输入驱动,该程序在altera cyclone IVE上验证通过
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  • DDS_BPSK
    基于DDS的BPSK调制器设计Verilog源码( U57FA u4E8.08 u868)
    2017-04-28 11:44:46下载
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  • MUX
    Multipleksor 3 to 1 - 3x1bit in, 1x1bit out
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  • jiecheng
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  • wireless
    基于FPGA DE0以及niosII的射频无线发送程序,采用spi接口操作无线模块nrf24l01(To spi interface operation wireless module nrf24l01 of FPGA DE0, as well niosII RF wireless transmitter program)
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  • alu
    this is the vhdl code for the arithmetic logic unit.enjoy!
    2013-08-22 18:51:35下载
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  • 74HC161
    74ls161 基于verilog语言的实现 源程序在压缩包的hdl文件夹中(74ls161 language based on the realization of verilog source package in compressed folder hdl)
    2020-07-01 17:00:01下载
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