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verilog HDL 写的LMS滤波器

于 2022-05-28 发布 文件大小:342.10 kB
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verilog HDL 写的LMS滤波器-LMS filter using verilog HDL language

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  • uart_rx
    uart接收模块 // 波特率:9600 // 数据位:8 // 停止位:1 // 校验位:0(UART receive module Baud rate: 9600 / / / data: 8 / / stop: 1 / / check digit: 0)
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