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LCD-Driver-(LabVIEW-2009)
Lab view using FPGA traing on lcd pannel
- 2012-03-23 23:50:54下载
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8051 VHDL核心，内有说明，很详细，值得下载…
8051单片机VHDL内核,内有说明,很详细,值得下载-8051 VHDL core, which has made it clear that, in great detail, it is worth downloading
- 2022-07-08 17:52:49下载
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Vhdl 语言中 16 位时间域卷积
卷积是在数字信号处理的常见操作。在此项目中，我创建了自定义电路利用大量的并行机制以提高性能与微处理器相比在 Nallatech 主板上实施。卷积将作为输入信号和 kernell 输出是另一个信号，输出信号的每个元素在哪里乘以内核的与输入信号的相应元素的所有元素组成的产品的总和。16 位无符号整数操作使用、 FPGA 将在 SRAM 中存储的输入的信号并将读取在内核中通过内存映射。
- 2023-04-06 14:45:04下载
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Altera公司的NIOSⅡ处理器，VHDL语言编译，然后在C语言下的nios……
ALTERA NIOS处理器，VHDL语言在QUARTUS编译通过，然后有C语言在NIOS SHELL下驱动，实验音频解码-Altera NIOS processor, the QUARTUS VHDL compiler, then the C language under NIOS SHELL-driven, experimental audio decoder
- 2022-03-21 08:10:03下载
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demo6-beep
说明： demo6 蜂鸣器实验
蜂鸣器演奏音乐(demo6 buzzer buzzer experiment playing music)
- 2020-12-27 22:59:02下载
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verilog编写的计算百分比模块
verilog编写的计算百分比模块-Verilog prepared by calculating the percentage module
- 2022-01-31 18:38:18下载
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VHDL language used to achieve 8
用VHDL语言实现8-3线编码器，16-4线编码器-VHDL language used to achieve 8-3 line encoder ,16-4-wire encoder
- 2023-08-20 10:35:02下载
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XLINX V5 芯片的DDR SDRAM参考设计
The xapp851.zip archive includes the following subdirectories. The specific
contents of each subdirectory below:
tl - HDL design files
sim - simulation files
synth - Synthesis related files
par - Place/Route related files
以及DDR SDRAM控制器设置.pdf文件
- 2023-08-29 16:40:03下载
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Altera-LVDS_IP
自己总结的Altera_LVDS的IP核的设计及仿真分析，已在实际工程中应用到，并且带有源代码和仿真代码，总结的文档，非常有用。(My summary of the Altera_LVDS IP kernel design and simulation analysis, has been applied in practical engineering, and with source code and simulation code, summary of the document, very useful.)
- 2020-12-16 14:39:13下载
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vhdl-cordic-atan-master
Implementation of CORDIC atan block in VHDL
- 2019-05-14 16:51:26下载
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