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基于 FPGA 的 VGA

于 2022-03-22 发布 文件大小:590.35 kB
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代码说明:

本代码是基于可编程门阵列flield视频图形阵列实现。该代码是使用Verilog

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  • bt656p
    说明:  BT656 时序, 逐行, 分辨率1280*960@25Hz(BT656 time series, row by row, resolution 1280*960@25Hz)
    2020-12-09 12:09:19下载
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  • 系统设计
    说明:  基于旋转编码器和LED灯组的强度调节系统设计(Design of Intensity Regulation System Based on Rotary Encoder and LED Lamp Set)
    2020-06-21 02:00:01下载
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  • 基于verilog的fir滤波器设计
    1. 了解Fir滤波器的设计原理和其线性特性; 2. 学会使用Verilog语言编程实现Fir滤波器的设计; 3. 熟悉quarters ii编程环境,并能够在此平台上实现文本设计、编译,并能够调用modelsim仿真出Fir滤波器的波形图; 4. 熟悉matlab软件的FDAtool工具和简单设计。
    2023-01-06 09:35:04下载
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  • Ddiggitalfiili
    数字滤波器的C语言实现,,包含高通、低通、带通滤波器 (The C language implementation of the digital filter, including the high-pass, low pass, band-pass filter)
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  • CodedLOCK
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    2013-08-27 21:37:06下载
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  • FSM
    It is the FSM implemented in Xylinx 14.7 on FPGA
    2015-09-28 15:50:09下载
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  • zhitouzi
    原创。掷骰子游戏,VHDL,quartus,北京邮电大学数电实验,实现随机掷骰子游戏,在数码管显示点数,点阵显示输赢,有开机动画以及开机音乐,可实现多人游戏等(games, VHDL, quartus,experiments of BUPT, pure originality,random game, in the digital display dots, dot matrix display winning or losing, there are boot animation and boot music, multiplayer gaming can be achieved)
    2020-12-24 20:49:04下载
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  • lanqiu24s8
    篮球24s计时。计时器递减计数到零时,数码显示器显示‘0’并停止,同时发出报警信号(basketball 24 seconds)
    2012-06-11 16:04:01下载
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  • LDPC
    LDPC Encoding Ebook Tetourial code
    2021-03-23 08:49:15下载
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  • 在quartus下搭建的数字锁相环
    在quartus下搭建的数字锁相环,能实现频率自动跟踪。(The digital phase-locked loop built under quartus can realize automatic frequency tracking.)
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