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6级流水，verilog实现浮点数的加法，其中浮点数格式符合IEEE754标准...
6级流水，verilog实现浮点数的加法，其中浮点数格式符合IEEE754标准-6 water, verilog realize the floating point adder, in which floating-point format in line with the IEEE754 standard
- 2023-09-01 12:35:04下载
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PIC16系列单片机的Verilog描述的完整性
完整的PIC16系列单片机verilog描述-A complete description of PIC16 series of microcontrollers verilog
- 2022-07-23 07:13:49下载
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adrv9009_fmcomms8_sync_test_bash
说明： adrv9009的测试平台的测试脚本，适合新人参考(Adrv9009 test platform test script, suitable for new reference)
- 2020-08-03 08:50:49下载
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它的译码器的VHDL程序
it s vhdl program for decoder
- 2022-11-23 15:15:04下载
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exp8
浙江大学体系结构实验课代码 实现5级流水线带有停顿，旁路和控制竞争的处理。(Experimental Architecture, Zhejiang University course code with a pause 5-stage pipeline, bypassing the treatment and control of competition.)
- 2020-09-26 12:07:46下载
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hdb3a
快速实现HDB3码与普通码二进制码的转换，方便学习与了解HDB3码的转换(Quickly achieve HDB3 code and common code binary code conversion, facilitate learning and understanding HDB3 code conversion)
- 2020-11-09 15:09:48下载
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wewe1sedfxfbgert er re
实施软件定义无线电的关键第一步是向与数字到模拟控制器接口。好花费的时间是在这工作，因为驾驶 DAC 的信号的时间必须是正确的设备才能正常工作。Spartan3e 培训师局是有 LTC2624 DAC 连接到通过 SPI 总线 FPGA。用于进行通信的 DAC 的信号是 SPI_MOSI、 DAC_CS、 SPI_SCK、 DAC_CLR。下表中描述的接口信号。
- 2022-04-24 20:37:42下载
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VHDL学习总结，简要概括了VHDL，非常适合做学习的总结
VHDL学习总结，简要概括了VHDL，非常适合做学习的总结-VHDL study conclusion, a brief summary of VHDL, very suitable for learning to do a summary of
- 2022-05-29 12:42:36下载
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是一个用vhdl语言编写的pwm程序，可以方便地用来和nios连接，实现对nios的功能扩展。...
是一个用vhdl语言编写的pwm程序，可以方便地用来和nios连接，实现对nios的功能扩展。-is a VHDL language with the PWM procedures can be used to facilitate connections and nios, nios to achieve a functional extension.
- 2022-07-11 04:57:55下载
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bhas
this is a vhdl program...
- 2013-08-17 23:30:56下载
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