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1K SRAM独立的读写端口，Verilog代码的ASIC设计

于 2022-02-07 发布文件大小:1.81 kB

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代码说明：

1K SRAM，安排字的32位，独立的读写端口，ASIC设计Verilog代码采用偶校验对1的计数。还带有测试平台

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mult_16
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ix746
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