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DE2板实现的带有记忆功能的秒表
1、verilog语言2、实现了秒表功能，且带有记忆功能。该秒表可以用于计时，且有复位、暂停和开始按钮； 开始计时后可以进行相应的记录。且该秒表带有两个暂停按钮，一个是暂停后秒表继续走， 另一个是暂停后秒表不走。3、开发环境：Altera-quartus
- 2022-07-13 06:36:45下载
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ConvolutionWithViterbiDecoding
QPSK调制下的（5,7）卷积码的编码和维特比译码与BPSK调制下（5,7）卷积码的编码和维特比译码的BER特性(QPSK modulation under (5,7) convolutional code encoding and Viterbi decoding and BPSK modulation (5,7) convolutional code encoding and Viterbi BER characteristic)
- 2020-12-12 20:09:15下载
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FPGA-based--DC-speed-controller
针对某船舶模型定位系统中调速电机，以FPGA(现场可编程门阵列)为控制器，采用数字比例积分调节器实现电机的速度控制算法，设计出数字化调速控制器(Positioning system for a ship model in the motor speed, the FPGA (field programmable gate array) for the controllers, proportional integral regulator with digital speed of the motor control algorithm, designed digital speed controller)
- 2011-05-17 15:50:57下载
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基于Basys3的贪食蛇游戏
基于Digilent Basys3的贪食蛇游戏，Xilinx Aritix7-35T FPGA芯片，用板载按键操作，VGA输出到显示器
- 2023-03-09 09:30:04下载
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apb timer
说明： 是基于apb总线下的timer外设的rtl代码，主要包括apb_timer的master逻辑verilog，以及相应的开发文档，包括寄存器的描述，功能特性等。(RTL code is based on timer peripheral under APB bus, which mainly includes master logic Verilog of apb_timer and corresponding development documents, including the description of registers, functional characteristics and so on.)
- 2019-01-25 16:54:02下载
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VHDL38decoder
VHDL 语言实现 38译码器 文件中包括 程序 源代码 还有 testbench 测试程序(38 decoder VHDL language implementation, including program source code file, there are testbench test procedures)
- 2020-06-29 23:40:03下载
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FIFO
fifi asyncronous and syncronus
- 2012-04-30 02:31:24下载
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Verilogmanual
VERILOG语言速查手册,与VHDL齐名的另外一硬件描述语言(verilog language manuals, and the other enjoying VHDL hardware description language 1)
- 2007-03-01 13:29:04下载
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BBTHG_II_t_x
KDP晶体二倍频与三倍频；基于耦合波方程组；已于实验结果校核 (Sum Frequency in KDP)
- 2021-03-16 11:39:21下载
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lesson38_lcd1602_clander
基于Verilog语言编写的LCD1602显示的日历程序，类似时钟功能值得参考。(LCD1602 shows calendar program based on Verilog language, similar clock function is worth reference.)
- 2019-05-26 09:29:18下载
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