▍1. 含移动储能单元的微网优化调度模型研究_吴婷
含移动储能的分布式电能优化调度，模型的处理与改进(Processing and improvement of distributed power optimization scheduling with mobile energy storage)
更多选项
▍3. 加扰器解扰器设计
加扰器解扰器设计,组合逻辑电路可以选用下述不同的逻辑类型来实现：互补CMOS结构、有比电路、差 分共源-共栅电压开关逻辑（DCVSL），传输门逻辑、互补传输晶体管逻辑（CPL）或动态电 路结构，也可以是以上不同类型结构的混合。(Scrambler/ descrambler design)
▍5. 21ic下载_16QAM调制解调器设计与FPGA实现
基于FPGA的16QAM调制器设计与实现(Design and implementation of 16QAM modulator based on FPGA)
▍6. DAC1220verilog代码
FGAP控制模拟量输出芯片DAC8812(FGAP control analog output chip DAC8812)
▍7. SG3525pinlvgenzong
采用SG3525实现感应加热电源的频率跟踪。(SG3525 is used to realize frequency tracking of induction heating power supply.)
▍8. verilog user guide
verilog语法说明，包含verilog golden reference guide，verilog 2001语法(verilog golden reference guide)
▍12. Interleaver
基于FPGA实现交织 在通信中交织的算法 已在板上通过测试(based on FPGA to Interleaver)
▍13. TimeGen3
能够绘制数字电路的时序图，是fpga工程师时序设计和分析的神器(for digital circuit timming design and analysis)
▍15. 03b1730cb31f464fa006a05ce501e8f18dc0
BIOMETRIC VICE RECOGNITION
▍18. LEDWATER
说明： LIUSHUIDENG VHDLYUYAN XIADE SHUIDENG(LEDWATER I WRITER IT MYSILF.IT'S EASY ! YOU CAN WRITER IT,TOO)
▍20. clock
说明： there's a clock divider for DE2 altra board clock (50MHz)
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