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Quartus flv configuration and commissioning of the

于 2023-08-05 发布 文件大小:2.48 MB
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QUARTUS 的配置及调试 flv的 -Quartus flv configuration and commissioning of the

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  • 分布式算法在20多年前被首次提出,但直到Xilinx发明FPGA的查找表结构以后,分布式算法才在20世纪90年代初重新受到重视,并被有效地应用在FIR滤波器的设...
    分布式算法在20多年前被首次提出,但直到Xilinx发明FPGA的查找表结构以后,分布式算法才在20世纪90年代初重新受到重视,并被有效地应用在FIR滤波器的设计中。 分布式算法是基于查找表的一种计算方法,在利用FPGA实现数字信号处理方面发挥着重要的作用,可以大大提高信号的处理效率。它主要应用于数字滤波、频率转换等数字信号处理的乘累加运算。 -see up
    2022-03-07 11:31:33下载
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  • ads7846
    四线电阻式触摸屏,ads7846控制显示触摸坐标(Four-wire Resistive Touch Panel, ads7846 touch control display coordinates)
    2009-03-31 20:07:16下载
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  • Verilog
    32位存储器Verilog附带test文件,可以在modulesim仿真 还有加法、减法器,译码器等常用Verilog器件,都附带仿真test。(Memory test with Verilog)
    2010-07-17 17:20:00下载
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  • nv04_context
    The description header can be found in signal_processing_library.h.
    2015-07-17 09:36:41下载
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  • waveform_-generator
    简易信号波形发生器,可以产生四种波形,频率1k-20K步进可调。学习Verilog HDL的好例子。(imple signal waveform generator, can produce four waveform, frequency 1 k-20 k step can be adjusted. Learning Verilog good example of HDL. )
    2011-06-12 21:13:27下载
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  • RS485
    verilog开发FPGA,实现RS485串口通信(RS485 driver for FPGA )
    2021-02-08 06:49:54下载
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  • uart_byte_rx
    说明:  libero soc工程,实现通过串口接收到单字节数据后并返回发送给上位机(Libero SOC project, which realizes receiving single byte data through serial port and sending it back to host computer)
    2020-06-21 09:20:01下载
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  • StopWatch
    This is a simple verilog code for stopwatch undre xlinx ISE webpack based for NEXYS3 board.
    2013-10-04 00:53:49下载
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  • 基于MATLAB模型设计的FPGA开发与实现
    说明:  MATLAB的SIMULINK和FPGA联合设计滤波器等,摆脱了传统的代码设计。(MATLAB's SIMULINK and FPGA jointly design filters and so on, and get rid of the traditional code design.)
    2020-10-23 16:07:23下载
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  • 基于Xilinx fpga的ddr2 控制器设计方法
    基于Xilinx fpga的ddr2 控制器设计方法-Xilinx fpga-based controller design method of ddr2
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