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很好的quartus软件仿真教程,flash版。

于 2023-03-08 发布 文件大小:15.19 MB
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很好的quartus软件仿真教程,flash版。-Good quartus software simulation tutorials, flash version.

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  • bujinconrrol
    步进电机定位控制系统,VHDL程序,里面有注释(Stepper motor position control system, VHDL program, there are comments)
    2010-11-27 17:36:34下载
    积分:1
  • widgets
    CSS配合jquery制作完美漂亮的时钟,貌似在IE8下时钟不能获取时间啊!支持ie9、chrome、safari、firefox、opera (Chrome显示效果最佳,IE9下时钟无法工作)日历和骰子是原创,CSS3时钟并非原创但经过改良支持opera。数字日历的兼容性不错,圆形时钟就差点了,也希望一起交流,共同改进。(CSS with the jquery make perfect beautiful clock, seemingly in IE8 under the clock can not get the time ah! Support ie9, chrome, safari, firefox, opera (Chrome show the best results, the clock does not work under IE9) calendar and dice is original, CSS3 clock is not original but after improved support opera. Digital calendar compatibility is good, almost round the clock on, and also hope together, and work together to improve.)
    2014-10-31 09:25:37下载
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  • PWM
    使用VerilogHDL语言加上IP核产生PWM调制波,占空比和频率可调。(The PWM modulation wave, duty cycle and frequency can be adjusted by using VerilogHDL language and IP kernel..)
    2015-06-05 10:29:28下载
    积分:1
  • Slave-FIFO
    详细讲解Slave FIFO模式下的初始化设置和相对应寄存器说明(Explain in detail the initial setup Slave FIFO mode and the corresponding register description)
    2014-03-18 17:33:23下载
    积分:1
  • 这是用verilog语言实现的1024点ff程序t
    这是用verilog语言实现的1024点ff程序t-This is achieved using Verilog 1024 language ff procedures point t
    2022-08-03 20:30:05下载
    积分:1
  • clk_div3
    基于XIlinx ISE,用Verilog语言实现3分频电路,适合初学者(Based XIlinx ISE, Verilog language using the frequency dividing circuit 3, suitable for beginners)
    2017-04-03 23:29:15下载
    积分:1
  • uart
    uart通信的Verilog实现,包含rx tx 以及testbench(Verilog implemention of UART telecommunicate)
    2018-09-18 17:06:06下载
    积分:1
  • LEDtest
    vhdl 实现fpga 闪灯控制 流水线闪灯 还用signalTAP进行检测,给初学者参考(vhdl fpga flash control lines to achieve flash is also used signalTAP testing, to advanced users)
    2010-06-10 16:27:57下载
    积分:1
  • 基于FPGA 的usb传输
    利用FPGA实现USB芯片CY7C68013与上位机的进行通信的系统,代码采用VHDL语言实现,利用状态机实现FPGA控制USB的数据传输,传输时序采用SLAVE FIFO实现
    2022-03-05 23:47:35下载
    积分:1
  • verilog 写的 多功能数字钟
    verilog 写的 多功能数字钟-verilog to write multi-functional digital clock
    2023-03-18 14:30:04下载
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