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altera several new FPGA configuration methods and the use of experience

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altera的几种新型的FPGA的配置方法和使用心得-altera several new FPGA configuration methods and the use of experience

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说明：网口UDP的FPGA仿真代码，经过测试能够实现预想功能(etherneit udp verilog fpga code)

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oc i2c master
NIOSII I2C接口模块及驱动程序，并含有测试程序。对想开发NIOS的工程师很有帮助(NIOSII I2C interface module and driver, and contains the test procedures. NIOS of engineers want to develop useful)

2007-08-20 19:37:02下载

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使用VHDL在CPLD上设计UART的一个项目-VHDL design UART

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说明： Xilinx Vivado 2018 License File

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图像降噪GUI界面，用到butterworth滤波器，中值滤波器和维纳滤波器，仅供参考。(noise reduction using media filter )

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FAST HADAMARD TRANSFORM VERILOG FOR IMAGE PROCESSING

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基于FPGA的超声波测距，通过数码管显示距离(FPGA-based ultrasonic distance)

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CPU流水线设计报告
说明： CPU课程设计要求以FPGA开发平台为例，分析 CPU 设计的流程与仿真。本次开发使用的硬件描述语言是 Verilog 语言，使用的指令系统是一个以 MIPS 指令集为子集的指令系统，共 22 条指令，所用的设计仿真软件Modelsim。(CPU curriculum design requires FPGA development platform as an example to analyze the process and Simulation of CPU design. The hardware description language used in this development is Verilog language, and the instruction system used is an instruction system with MIPS instruction set as a subset, with 22 instructions in total. The design simulation software Modelsim is used.)

2020-12-24 12:09:05下载

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