登录
首页 » Verilog » 除頻器

除頻器

于 2022-04-26 发布 文件大小:13.92 MB
0 73
下载积分: 2 下载次数: 1

代码说明:

altera Quartus Prime 15.1 Standard Edition的 I2C master code. 含除頻器

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论


0 个回复

  • 程序
    说明:  传感器是一种检测装置,能感受到被测量的信息,并能将感受到的信息,按一定规律变换成为电信号或其他所需形式的信息输出,以满足信息的传输、处理、存储、显示、记录和控制等要求(Sensor is a kind of detection device, which can sense the measured information and transform it into electrical signal or other required information output according to certain rules to meet the requirements of information transmission, processing, storage, display, recording and control.)
    2020-06-18 22:00:01下载
    积分:1
  • 用Verilog HDL实现的uart通用串口通信程序,已经验证成功
    在ISE下开发的通用串口通信程序,使用的编程语言是Verilog HDL语言,采用了fifo,已经进行实验验证通过,适合Verilog初学者,欢迎交流学习。
    2022-07-10 18:29:55下载
    积分:1
  • Synthesis_and_Fpga_Implementation_of_UAR
    Synthesis and fpga implementation of UART
    2018-12-03 14:06:02下载
    积分:1
  • 1 _ + + + d5m Nios SoC的TFT
    用DE1_SoC实现了D5M的显示,可以通过VGA和TFT屏来显示图像,将FPGA的数据传到Nios以便用C做复杂的算法处理。
    2023-02-09 00:55:10下载
    积分:1
  • 用FPGA实现GPS数据解析,Verilog测试通过
    用FPGA实现GPS数据解析,基于Verilog实现,并通过串口发送时间信息
    2022-03-02 02:41:56下载
    积分:1
  • ds312_Spartan-3E-FPGA
    FPGA资料与所用元器件的数据参考手册与应用指南(ds312_Spartan-3E FPGA Family )
    2012-09-18 21:43:54下载
    积分:1
  • FPGA按键延时模块 debounce
    说明:  FPGA按键延时模块,产生key_value和key_flag 可直接例化调用(The key delay module of FPGA)
    2020-06-22 04:20:02下载
    积分:1
  • I2C MASTER
    说明:  I2C verilog code I2C僅使用兩個雙向開漏線,串列資料線(SDA)和串列時鐘線(SCL),上拉了電阻。使用的典型電壓是+5 V或+3.3 V(雖然其他電壓系統也是允許的)。 在I2C參考設計中,使用7位或10位(取決於所使用的裝置)位址空間。普通I2C匯流排速度為100 kbit / s的標準模式和10 kbit / s的低速模式,但任意低時脈速率也是允許的。 I2C的最新修訂可以承載更多的節點,並以更快的速度執行[b]。這些速度被更廣泛地使用在嵌入式系統中而不是PC上。I2C也有其他的特性,例如16位元尋址。(I2C verilog code I2C (Inter-Integrated Circuit))
    2019-03-20 19:25:23下载
    积分:1
  • xapp585
    LVDS并行数据传输,来自XILINX官网(LVDS Parallel Data Transfer)
    2020-06-29 08:20:02下载
    积分:1
  • generate-coordinates
    使用VHDL编写语言,巧妙的利用计数器和循环输出一个坐标系,由于VHDL出现负数比较麻烦,全部由正数代替,输出一个原点在中心,半径128的256×256的坐标。方便坐标变换以及用此坐标做算法。(Use of VHDL language, clever use of counter and loop outputs a coordinate system, because VHDL negative too much trouble, all replaced by a positive number, the output an origin at the center, radius 128 256 256 coordinates. Convenient coordinate transformation and coordinate to do with this algorithm.)
    2013-08-28 11:03:46下载
    积分:1
  • 696518资源总数
  • 105267会员总数
  • 12今日下载