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这是一本关于VHDL编程的书籍,网上突然发现的,相信对相关人员会有所用途....
这是一本关于VHDL编程的书籍,网上突然发现的,相信对相关人员会有所用途.-This is a book on VHDL programming, on-line suddenly found, I believe that the relevant staff will be use.
- 2023-02-06 08:50:07下载
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LCD 因其轻薄短小,低功耗,无辐射,平面
直角显示,以及影像稳定等特点,当今应用非常
广泛。CPLD(复杂可编程逻辑器件) 是一种具有
丰富可编程...
LCD 因其轻薄短小,低功耗,无辐射,平面
直角显示,以及影像稳定等特点,当今应用非常
广泛。CPLD(复杂可编程逻辑器件) 是一种具有
丰富可编程功能引脚的可编程逻辑器件,不仅可
实现常规的逻辑器件功能,还可以实现复杂而独
特的时序逻辑功能。并且具有ISP (在线可编
程) [1 ] 功能,便于进行系统设计和现场对系统进
行功能修改、调试、升级。通常CPLD 芯片都有
着上万次的重写次数,即用CPLD[ 2 ] 进行硬件设
计,就像软件设计一样灵活、方便。而现今LCD
的控制大都采用专用控制芯片,且一般都采用进
口芯片,成本较高。并且为了保证在特定环境下
控制芯片能正常工作,往往要加上必需的与门、
非门、以及HC244 ,HC245 、HC373 等元件,这样
不仅提高的成本,也因分立元件的引入而降低了
电路的可靠性。本设计的目的是采用Xilinx 公
司生产的一片XC95288 和一片XC95144 来实现
LCD 控制器以及其外围控制,时序逻辑的全部
功能,使得LCD 控制系统故障率和开发成本大
大降低,并使LCD 控制系统有强大的功能可扩
展性。-err
- 2023-07-11 03:35:03下载
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doorlock
基于FPGA设计的电子密码锁是一个小型的数字系统，与普通机械锁相比，具有许多独特的优点：保密性好，防盗性强，可以不用钥匙，记住密码即可开锁等。(FPGA-based design of the electronic code lock is a small digital system. It has many unique advantages：good privacy and security , it do not need the key but remember password to unlock, and so on while it compare to ordinary mechanical locks.)
- 2013-12-25 21:24:41下载
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3P3_wimdow
图像插值算法，窗口为3*3,用于图像的除去死点，以及提高清晰度或者使图像柔和(3*3 window)
- 2012-02-28 15:36:02下载
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buffer
用verilog实现的buffer，经过了fpga平台验证。(Implement buffer with verilog.)
- 2020-10-28 12:19:58下载
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source
I2C MASTER DESIGNED by Verilog
- 2020-06-18 23:40:02下载
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STM32F407FFT
说明： 使用STM32官方提供的DSP库进行FFT，虽然在使用上有些不灵活（因为它是基4的FFT，所以FFT的点数必须是4^n），但其执行效率确实非常高效，看图1所示的FFT运算效率测试数据便可见一斑。该数据来自STM32 DSP库使用文档(. Using the official DSP library provided by STM32 for FFT is not flexible in use (because it is the FFT of base 4, so the number of FFT points must be 4 ^ n), but its execution efficiency is really very efficient, as can be seen from the test data of FFT operation efficiency shown in Figure 1. This data comes from STM32 DSP library usage document)
- 2020-06-20 19:00:02下载
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rough22
采用倍频及1/3、1/12倍频绘制的路面不平度频谱图（自编）(Using octave and 1/3, 1/12 octave drawn road roughness spectrum (self))
- 2013-09-10 16:50:13下载
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jk-filpflop
这个是vhdl中很常见的jk filpflop的文件只用于很小数位的变化 其中的jk文件是up down运算都符合的(This is a very common vhdl jk filpflop file is only used for very small changes in a digital file which jk is up down operations are met)
- 2013-11-19 11:43:07下载
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sobel
在FPGA中，采用verilog HDL语言实现图像处理算法sobel，仿真实验通过(In the FPGA using verilog HDL language image processing algorithms sobel, simulation experiment)
- 2021-01-15 20:58:46下载
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