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使用 nios 和 verilog hdl tcp/ip 通信通过使用来创建 DM9000A,它可以起到 5 Mb/s

于 2022-02-06 发布 文件大小:539.80 kB
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使用 nios 和 verilog hdl tcp/ip 通信通过使用来创建 DM9000A,它可以工作到 5 Mb/s 我已经用它在 DE2 板,你下载它和可以将复制到您的项目,然后使用它直接

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  • Final_final_test
    五级流水CPU设计 流水线是数字系统中一种提高系统稳定性和工作速度的方法,广泛应用于高档CPU的架构中。根据MIPS处理器的特点,将整体的处理过程分为取指令(IF)、指令译码(ID)、执行(EX)、存储器访问(MEM)和寄存器会写(WB)五级,对应多周期的五个处理阶段。一个指令的执行需要5个时钟周期,每个时钟周期的上升沿来临时,此指令所代表的一系列数据和控制信息将转移到下一级处理。(Five level flow CPU design)
    2020-10-18 16:07:26下载
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  • 13.3_Tracing
    基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,基于视频的运动跟踪(System Generator based image processing engineering, multimedia processing on FPGA source, video-based motion tracking)
    2020-11-04 17:39:51下载
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  • source
    I2C MASTER DESIGNED by Verilog
    2020-06-18 23:40:02下载
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  • half_band
    半带滤波器verilog源代码,主要用于采样率变换系统中,采用乘法积累加器,很好的例子,供大家参考(Half band filter verilog code, mainly for the sampling rate conversion system, use the multiplication accumulation adder, a good example, for your reference)
    2020-12-23 10:59:07下载
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  • S03_基于ZYNQ的DMA与VDMA的应用开发
    说明:  VIVADO dma以及vdma 使用文档 基于ZYNQ 7020(vivado DMA&VDMA example text of zynq)
    2020-06-17 11:40:02下载
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  • 基于fpga的信号发生器DDS
    说明:  基于fpga的信号发生器,通过调整按键可以生成正弦波,方波,三角波,锯齿波(Sine wave, square wave, triangular wave, sawtooth wave)
    2020-07-19 21:21:12下载
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  • s5pv-u-boot-LCD-display
    s5pv-u-boot-2011.06之增加LCD显示功能(s5pv-u-boot-2011.06 Increase LCD display function)
    2013-03-14 09:45:18下载
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  • Buzzer-music
    基于FPGA实现蜂鸣器播放音乐的功能 使用芯片为EP2C8Q208C8N,使用普通蜂鸣器,由于频率不同可实现放歌功能,本例设计的是《友谊地久天长》,使用Verilog语言编程,本例子有工程文件、仿真、波形,经过测试可以使用。(Play music based on FPGA buzzer functions using chip EP2C8Q208C8N, using ordinary buzzer, since the frequency of different functions can be realized sing, in this case the design is " Auld Lang Syne" , using Verilog language programming, this project examples files, simulation, waveform, tested can be used.)
    2016-07-05 16:15:13下载
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  • 测试AD9280的功能,用verilog编写
    通过verilog编写AD9280的测试程序,将AD9280采集的数据存储到sdram中,然后读取sdram中的数据,发送到串口进行保存。
    2022-08-12 16:55:30下载
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  • can-lite-vhdl-master
    说明:  CAN VHDL Code. Behavioral implementation of CAN bus interface.
    2021-01-19 21:48:41下载
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