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DA模块(TLC5620)、AD模块(TLV1544)

于 2022-02-05 发布 文件大小:8.55 MB
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代码说明:

//顶层模块 //本次正弦波频率大约在750-800Hz,没有精确计算,和DA的加载时间有关 module DA_AD ( clk, rst_n, DAC_SCLK, DAC_DATA, DAC_LDAC, DAC_LOAD, ADC_SDO, ADC_SDI, ADC_SCLK, ADC_EOC, ADC_CS, ADC_FS, led1 ); input clk; input rst_n; output DAC_SCLK; output DAC_DATA; output DAC_LDAC; output DAC_LOAD; //AD相关 input ADC_SDO; //ADC转换完成输出的数据 input ADC_EOC; //ADC的转换完成输出信号 output ADC_SDI; //ADC的输入数据 output ADC_SCLK; //ADC时钟信号 output ADC_CS; //ADC片选,低有效 output ADC_FS; //DSP模式帧起始信号 output led1; wire DATA_EN; wire [7:0] Cordic2driver; wire start; TLC5620_driver ins_TLC5620_driver ( .clk(clk), .rst_n(rst_n), .DATA_IN(Cordic2driver), .DATA_EN(DATA_EN), .

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  • 55593402DDS_vhdl
    DDS分频实现,全部代码的完整过程,包括截图等(DDS divider to achieve the complete process of all the code)
    2013-05-15 16:49:55下载
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    verilog写的39阶通带为20KHz的半带fir滤波器,经测试正确。(verilog halfband FIR)
    2020-12-25 14:29:04下载
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    对MAX5250芯片进行控制,实现DA转换输出。(Controlling MAX5250 Chip)
    2019-06-27 14:19:36下载
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    SDRAM的相关资料!包括三星的资料。有大量的论文,有原理图,有仿真程序等。
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