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VS2017离线安装时程序包清单验证失败 解决办法
VS2017离线安装时程序包清单验证失败 解决办法，安装证书后安装出现“程序包清单验证失败” ，关闭校验后，删除离线包内的cs_installer。opc文件 用此文件替换 ，再次运行安装即可通过
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新安江模型程序
新安江模型程序，vb程序包，界面可以直接用
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MQTT服务器搭建教程
本教程为本地MQTT服务器搭建，搭建此本地MQTT服务器必须先为电脑配置java 环境，然后用CMD命令按步骤运行apache-apollo-1.7.1下相关exe搭建服务器管烨员:C: Windowssystem32 cmd.exe215/1/291:55example#215/1/2916:55ed hD: vapache-apo1lo-1.7.1 in >ddr卷是软件卷的序列号是FAD4418D: Mapache- apollo-1.7.1hin的目录E17/81421:4 d1r卷是软件卷的序列号是FAD4418D: pache-apo11o-1.71 bin roker in的目录E17/g81421:41dir驱动器卷是软件卷的序列号是FD4-418D:< apache-apo1lo-1.71 bin Broker in的目录217/981421:41apoIlo-broker run红框内第一行是监听,监听端口是,客服端链接时输入电脑的地址即可,本机可使用命令查询。绿框内为控制台地址,在浏览器输入可现实控制台界面。c管埠员: CAWindows system32 cmd.exe- apollo-broker run一巴回[9Gv[37ml∈[32mc[37 mApache Apo11a←[2mINFO i AyulINFo Starting store: leveldb store at D: apac he-apo1lo-1-7.1 in Nmybraker vdatMARN Using the pure java Leve lDB implementation which is still experimentalIf the NI version is not available for your platform, please switch to the BDBstoreinsteadhttp://activemg.apache.org/appllo/docunentation/user-manual.htmlNro I Accepting connections at: tcp://6.5.6.G:G1G1JNFO白 ccepting connect1 ons at:t1s:/.回,.日=6⊥614NFo Accepting connections at: us://0.0.4.2=61623/Fo Accepting connections at: uss://.0.6-G:61624INFOvirtual host startup is wait ing on store startupINFO i virtual host startup is no longer waiting- It waited a total of 1 seconNfoAdministrationinterfaceavailableat:https://127.0.0.1:61681/INFOAdministrat iun interface dudildlle at: htLp://1270-0-1:616808.用户名默认: admin,密码: password←C▲不安全p127.0.0.161681/ onsale/in dex. hlIIIApollo ConsoleogInUsernamePassward5控制台界面Apache Apollo -AntCA承我全琳低!1n(1h1 ronnie/nrf=hm匈☆Apollo ConsoleadminVirtual Hosts Connectors operat ng Ervironment ConfiguratioVirtual Host: mybrcke-ETAIL5ueues Topics Durable SubsSince:2017//5下午10:A0Name: nomcCrcaHostNo Queues have been created yet.STORE STATUS
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matlab 博弈论频谱分配
比较好的学习学习博弈论的代码，博弈论被应用于各种领域。可以学习学习
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可以在单片机上计算的BP神经网络C语言工程（修改bug版）
在计算机上训练，将训练后的参数给单片机，单片机来仿真，之前已经在stm32f4上成功仿真过
- 2020-11-01下载
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Qt实现周立功CAN
使用Qt5.7调用周立功CANTest动态库文件完成CANTest的基本收发数据的功能。文件包含三个版本，大家可以参考使用！
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led点阵屏16*32 完整设计资料（毕业设计）
led点阵屏16*32 包含从原理到电路设计、软件设计再到PCB设计、程序编写 及 电脑端下载软件设计（Visualbasic）。整套完整资料 包含完整毕业设计论文
- 2020-12-05下载
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基于FPGA的8b10b编解码verilog实现
本设计是采用EDA技术设计的一种8B /10B 编解码电路,实现了在高速的串行数据传输中的直流平衡。利用verilog HDL 逻辑设计语言，经过modelsim、quartus II的仿真和下载验证，实现其编码和解码的功能。该编解码电路设计大体上可以由五个模块构成，分别是默认编码模块、差异度计算模块、编码校正模块、并串转换模块、显示模块。采用Verilog HDL 描述、modelsim 10.2a 进行功能仿真、Quartus II 13.1 进行FPGA逻辑综合和适配下载，最后在Alter 公司的Cyclone IV E 的芯片EP4CE6F17C8 上实现并完成测试。资源包中附有
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matlab转速电流双闭环直流调速系统仿真
【实例简介】matlab转速电流双闭环直流调速系统仿真，含有一个设置参数的m文件和一个simulink仿真文件，运动控制系统课程设计可用
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VGG16模型tensorflow实现
包括数据集预处理以及生成tfrecord文件，用自己数据集训练VGG16，亲测可用
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