DDR3_256MByte

代码说明：

说明：  基于K7的FPGA的DDR3读写程序，通过串口发送1024位的数据，写到FPGA的DDR3端，然后将数据从DDR3中读取出来，通过串口发送到PC端。(The DDR3 reading and writing program of FPGA based on K7 sends 1024 bit data to DDR3 end of FPGA through serial port, then reads data from DDR3 and sends it to PC through serial port.)

文件列表：

DDR3_256MByte\.Xil\Vivado-9512-LAPTOP-HB6EUDTQ\hw_ila_data_1\xsim.dir\snapshot\xsim.dbg, 3496 , 2018-07-05
DDR3_256MByte\.Xil\Vivado-9512-LAPTOP-HB6EUDTQ\hw_ila_data_1\xsim.dir\snapshot\xsim.rtti, 1125 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\5363ae41685ecd6c\5363ae41685ecd6c.xci, 268798 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\5363ae41685ecd6c\u_ila_0_0_CV.dcp, 1890478 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\892c10722b89e868\892c10722b89e868.xci, 6213 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\892c10722b89e868\dbg_hub_CV.dcp, 210097 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\d258f8d21c5bf1c7\d258f8d21c5bf1c7.xci, 268798 , 2018-07-05
DDR3_256MByte\DDR3.cache\ip\d258f8d21c5bf1c7\u_ila_0_0_CV.dcp, 1889364 , 2018-07-05
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DDR3_256MByte\DDR3.cache\wt\synthesis.wdf, 3739 , 2018-07-05
DDR3_256MByte\DDR3.cache\wt\synthesis_details.wdf, 100 , 2018-07-05
DDR3_256MByte\DDR3.cache\wt\webtalk_pa.xml, 1609 , 2018-07-05
DDR3_256MByte\DDR3.hw\DDR3.lpr, 343 , 2018-07-05
DDR3_256MByte\DDR3.hw\hw_1\hw.xml, 39827 , 2018-07-05
DDR3_256MByte\DDR3.hw\hw_1\layout\hw_ila_1.layout, 246910 , 2018-07-05
DDR3_256MByte\DDR3.hw\hw_1\wave\hw_ila_data_1\hw_ila_data_1.wcfg, 9106 , 2018-07-05
DDR3_256MByte\DDR3.hw\hw_1\wave\hw_ila_data_1\hw_ila_data_1.wdb, 7110 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\.xsim_webtallk.info, 60 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\labtool_webtalk.log, 682 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\labtool_webtalk.tcl, 3106 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\usage_statistics_ext_labtool.html, 2964 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\usage_statistics_ext_labtool.wdm, 1138 , 2018-07-05
DDR3_256MByte\DDR3.hw\webtalk\usage_statistics_ext_labtool.xml, 2566 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_1.xml, 202 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_10.xml, 451 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_11.xml, 451 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_12.xml, 260 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_13.xml, 695 , 2018-07-05
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DDR3_256MByte\DDR3.runs\.jobs\vrs_config_15.xml, 695 , 2018-07-05
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DDR3_256MByte\DDR3.runs\.jobs\vrs_config_18.xml, 243 , 2018-07-05
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DDR3_256MByte\DDR3.runs\.jobs\vrs_config_2.xml, 219 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_20.xml, 232 , 2018-07-05
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DDR3_256MByte\DDR3.runs\.jobs\vrs_config_22.xml, 437 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_23.xml, 437 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_24.xml, 272 , 2018-07-05
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DDR3_256MByte\DDR3.runs\.jobs\vrs_config_26.xml, 475 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_27.xml, 449 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_28.xml, 449 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_29.xml, 259 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_3.xml, 202 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_30.xml, 915 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_31.xml, 449 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_32.xml, 251 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_33.xml, 449 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_34.xml, 449 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_35.xml, 236 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_4.xml, 202 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_5.xml, 219 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_6.xml, 391 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_7.xml, 219 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_8.xml, 695 , 2018-07-05
DDR3_256MByte\DDR3.runs\.jobs\vrs_config_9.xml, 451 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\.vivado.begin.rst, 189 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\.vivado.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\.Vivado_Synthesis.queue.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\.Xil\clk_wiz_0_propImpl.xdc, 421 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\clk_wiz_0.dcp, 10077 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\clk_wiz_0.tcl, 3427 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\clk_wiz_0.vds, 23636 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\clk_wiz_0_utilization_synth.pb, 231 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\clk_wiz_0_utilization_synth.rpt, 6949 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\dont_touch.xdc, 2281 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\gen_run.xml, 2007 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\htr.txt, 379 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\ISEWrap.js, 4766 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\ISEWrap.sh, 1622 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\project.wdf, 1840 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\rundef.js, 1259 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\runme.bat, 229 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\runme.log, 23767 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\runme.sh, 1088 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\vivado.jou, 559 , 2018-07-05
DDR3_256MByte\DDR3.runs\clk_wiz_0_synth_1\vivado.pb, 37266 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.init_design.begin.rst, 189 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.init_design.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.opt_design.begin.rst, 189 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.opt_design.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.place_design.begin.rst, 189 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.place_design.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.route_design.begin.rst, 189 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.route_design.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.vivado.begin.rst, 178 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.vivado.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.Vivado_Implementation.queue.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.write_bitstream.begin.rst, 180 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\.write_bitstream.end.rst, 0 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3.bin, 11443612 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3.bit, 11443713 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3.mcs, 10761048 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3.tcl, 1786 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3.vdi, 5190 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3_11860.backup.vdi, 713 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3_clock_utilization_routed.rpt, 65256 , 2018-07-05
DDR3_256MByte\DDR3.runs\impl_1\DDR3_control_sets_placed.rpt, 220033 , 2018-07-05