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Modulator70

于 2011-07-29 发布 文件大小:1KB
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代码说明:

  个人参与的某国家工程并行排序MATLAB程序,用于FPGA的RTLAB仿真,使用Simulink工具生成HDL代码。测试可用。(Individuals involved in sort of a national engineering parallel MATLAB programs for the FPGA RTLAB simulation, using the Simulink tool to generate HDL code. Test available.)

文件列表:

Modulator70.m,5446,2011-07-27

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